第5章 锁存器、触发器和寄存器_第1页
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锁存器、触发器和寄存器

两个交叉耦合的或非门组成

输入改变，输出就跟着改变吗?说明1010置10101置000保持1100引发不定状态Q*称作新状态(或次态）置位复位

RS1100RS0011RS0000110000RS0001RS0010

置位复位两个交叉耦合的与非门组成

输入改变，输出就跟着改变吗?说明0110置11001置011保持0011引发不定状态Q*称作新状态(或次态）

00

001111

1100

111111

1110

1101

说明0110置11001置011保持0011引发不定状态

说明1010置10101置000保持1100引发不定状态门控的SR锁存器基本锁存器的问题：输出状态对输入很敏感输入信号必须满足约束条件控制信号来控制状态发生变化的时刻

与非门CSR说明11010置位10101复位100保持11100引发不定状态0XX保持控制信号有效时锁存器能够正常工作控制信号𝐶无效时，锁存器保持原来的状态约束条件：𝑆∙𝑅=0

√D锁存器SR锁存器基本锁存器的问题：输入信号必须满足约束条件置位信号和复位信号不同时有效SRCD说明111置位100复位0X保持𝐶为高电平时，输出𝑄随输入𝐷的变化而变化；𝐶为低电平时，输出𝑄保持𝐶从高变为低前一刻的值D锁存器问题：透明性D锁存器：电平触发√主从边沿D触发器D锁存器的问题：透明性主从D触发器特点D触发器能够保存时钟上升沿时刻的数据输入𝐷的值，且能够保存一个时钟周期带异步复位和置位的D触发器很多情况下需要能够强制触发器的输出为0（清零）或为1（置位）使用带复位和置位的D锁存器来构成D触发器D锁存器的复位/置位直接作用，是异步控制信号基本的通用寄存器一个触发器可以存储1bit信息一组n个触发器就可以保存nbit数据共用一个时钟共用控制信号带使能控制的寄存器并行加载功能：增加一个控制信号load：

load有效时，数据加载到寄存器load无效时，数据不能加载至寄存器，寄存器保持原来的数据不变方法：使能信号控制的触发器输入D的信号EN=1，选择DEN=0，选择Q带加载控制的4-bit寄存器移位寄存器移位寄存器由多个触发器构成每个触发器的输出连接下一个触发器的输入所有的触发器使用同一个时钟来触发移位操作。移位寄存器有什么用处？01101100001101clk2clk10011003clk014clk001101101移位寄存器有什么用处？延时串入并出具有并行访问功能的移位寄存器串并转换并串转换控制信号工作模式触发器输出0向右移位1并行加载功能表触发器的输入有两个不同的数据源前一个触发器的输出或串行输入并行加载的外部输入双向移位寄存器功能表具有并行访问功能的移位寄存器串并转换并串转换控

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