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文档简介

AD采集实验,实验目的,1.了解TMS320F2812片上外设AD; 2.熟悉片上AD的使用; 3.利用片上AD进行采集数据。,实验内容,1.初始化系统; 2.初始化系统,进行通道的选择; 3.AD数据的采集。,实验背景知识,ADC模块框图,ADC模块的特点,1.共有16个模拟量输入引脚,将这16个引脚分成了2组:A组的引脚 为ADCINA0ADCINA7,B组为ADCINB0ADCINB7; 2.具有12位的ADC内核,内置2个采样保持器S/H-A和S/H-B; 3.ADC模块的时钟频率最高可配置25Mhz,采样频率最高为12.5MSPS; 4.ADC模块的自动序列发生器可以按2个独立的8位状态序列发生器 SEQ1和SEQ2来运行,也可以按一个16状态序列发生器SEQ运行; 5.ADC模拟输入的范围为03V; 6.ADC模块对一个序列的通道开始转换必须要有一个启动信号,或者 是一个触发信号; 7.ADC模块共有16个结果寄存器来保存转换的数值;,序列发生器,ADC模块既支持两个8状态的序列器:SEQ1和SEQ2分开独立工作, 此时称双序列发生器;也支持SEQ1和SEQ2级联成一个16状态的 序列发生器SEQ,称级联序列发生器。,多路转换示意图,同一时刻,ADC模块只能对一个通道的信号进行转换,AdcRegs.ADCTRL1.bit.RESET=1;/1:整个ADC模块软件复位;0:没有影响; AdcRegs.ADCTRL2.bit.RST_SEQ1=1;复位序列发生器1; 0:不起作用;1:立即复位序列发生器到CONV00状态; AdcRegs.MAX_CONV.bit.MAX_CONV=15; NOP;/除非另有规定 AdcRegs.ADCTRL1.bit.RESET=0; AdcRegs.ADCTRL1.bit.SUSMOD=3;/仿真暂停方式。 方式3时,序列发生器和其他数字电路逻辑立即停止 AdcRegs.ADCTRL1.bit.ACQ_PS=0;采集窗口大小。 控制SOC脉冲的宽度,同时也确定了采样开关闭合的时间。 SOC脉冲的宽度是(ACQ_PS+1)个ADCLK周期数。 AdcRegs.ADCTRL1.bit.CPS=0;采集窗口的大小0:FCLK=CLK/1; 1:FCLK=CLK/2;CLK为标定后的HSPCLK AdcRegs.ADCTRL1.bit.CONT_RUN=0;连续运行 0:启动停止方式;1:连续转换方式; AdcRegs.ADCTRL1.bit.SEQ_CASC=1;级联序列发生器工作方式 0:双序列;1:级联模式; AdcRegs.MAX_CONV.bit.MAX_CONV=15;最大转换通道寄存器 AdcRegs.CHSELSEQ1.bit.CONV00=6;/硬件连接到了ADCINA6 AdcRegs.CHSELSEQ1.bit.CONV01=1;ADC输入通道选择序列控制寄存器,AdcRegs.ADCTRL3.bit.ADCBGRFDN=3;ADc带隙和参考的电源控制 AdcRegs.ADCTRL3.bit.ADCPWDN=1;ADC电源控制; 1:除带隙和参考电路外的ADC其他模拟电路掉电 AdcRegs.ADCTRL3.bit.ADCCLKPS=8;ADC内核时钟分频器。 ADCCLK=HSPCLK/16*(ADCTRL17+1) AdcRegs.ADCTRL3.bit.SMODE_SEL=1;采样方式选择;0:顺序采样;1:并发采样 AdcRegs.ADC_ST_FLAG.bit.INT_SEQ1_CLR=1;状态和标志寄存器,中断清除位。 1:向该位写1;清除SEQ1中断标志位INT SEQ1 AdcRegs.ADC_ST_FLAG.bit.INT_SEQ2_CLR=1; AdcRegs.ADCTRL2.bit.EVB_SOC_SEQ=0; 在级联序列发生器方式下,EVB启动转换使能位,只在级联方式下0:不起作用;1:该位置1; AdcRegs.ADCTRL2.bit.RST_SEQ1=0; AdcRegs.ADCTRL2.bit.INT_ENA_SEQ1=1; SEQ1中断使能,该位能使SEQ1向CPU发出中断请求。 0:禁止SEQ1的中断请求;1:使能SEQ1中断请求; AdcRegs.ADCTRL2.bit.INT_MOD_SEQ1=0;SEQ1中断方式. 0:每个SEQ1序列转换结束时,置位SEQ1的中断标志; 1:每隔一个SEQ1序列结束时,置位SEQ1的中断标志位; AdcRegs.ADCTRL2.bit.EVA_SOC_SEQ1=0;SEQ1事件管理器A的SOC屏蔽位。 0:不能通过EVA出发启动SEQ1;1:允许EVA触发启动SEQ1/SEQ1 AdcRegs.ADCTRL2.bit.EXT_SOC_SEQ1=0;SEQ1的

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