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文档简介

四位数值比较器班级： 电子信息工程（2）班 姓名： 林贤款 学号： Xb13610208 时间： 2015.122015.12 一、实验目的。1、设计四位二进制码比较器，并在QuantusII上进行仿真。2、掌握VHDL设计实体的基本结构及文字规则。二、实验要求。1、用VHDL语言编写四位二进制码比较器的源文件；2、对设计进行仿真验证；三、实验原理。本实验实现要实现两个4位二进制码的比较器。即当输入为两个4位二进制码 和 时, 输出为M（A=B）,G（AB）和L（AB时，G处接的二极管亮；当AnewVHDLfile），新建完成之后要先保存。4、编写程序（原程序如下a所述）。5、检查语法（点击工具栏的这个按钮 )。6、锁定引脚，点击工具栏的（如下管脚分配所述）。六、实验结果。1、编译结果无误图。2、仿真波形图： 当=1011，=1101时，AB，L为高电平，即L=1。3、管脚分配图。 查找开发板管脚分配图，按照规定给相应输入输出端分配管脚，分配要合理、方便观察结果。七、实验心得。本次实验中，自己进一步理解了比较器的原理。当A、B输入端分别输入任意的电平时，会进行一个比较。若AB时，则G输出端接的发光二极管亮；A=B时，则M输出端接的发光二极管亮。输出结果要写一个完整的，健壮的程序，必须考虑完全，并且要使程序的可综合性强，最主要的一点是要勤动手，多写程序，多思，才能有所提高。知道了学以致用的重要性，学的很多知识不运用不能是真正的掌握，这一点在我身上很是有所体现。四位比较器VHDL源文件：libraryieee;useieee.std_logic_1164.all;useieee.std_logic_arith.all;useieee.std_logic_unsigned.all;entitycomp4isport(A:instd_logic_vector(3downto0);B:instd_logic_vector(3downto0);M,G,L:outstd_logic);endcomp4;architecturebehaveofcomp4isbeginp1:process(A,B)beginif(AB)thenG=1;M=0;L=0;elsif(AB)thenG=0;M=0;L=1;elsif(A=B)t
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