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文档简介

一、实验目的 1能够了解BCD 七段显示译码器的设计原理。 2能够用VHDL语言设计一个BCD 七段显示译码器电路。 3能够自行验证设计电路的正确性。二、实验设计内容及要求：1用vhdl语言设计一个BCD 七段显示译码器，并下载到实验板上。2要求输入信号为四位，并按照BCD 码的值进行显示。三、实验器材：1 软件：Altera公司的QuartusII软件。2 芯片：Altera公司的EP2C8T144C8。3 开发平台：台湾掌宇公司的CIC310智能型可编程数字开发系统。四、 实验步骤 1建立名为bcd_decorder的工程文件，并建立VHDL文本编辑文件在编辑环境中编写VHDL程序。代码如下：library ieee;use ieee.std_logic_1164.all;entity bcd_decoder isport(i:in std_logic_vector(3 downto 0); y:out std_logic_vector(7 downto 0);end;architecture one of bcd_decoder isbeginprocess(i)begin case i is when0000=yyyyyyyyyyyyyyyyy=11111111; end case;end process;end;2保存文件，并检查编译。3建立波形文件，进行功能仿真后波形如下图所示：图表 14测试电路功能，完成下表输入3.0输出字型输入3.0输出字型00001000000110010010101000111011010011000101110101101110011111115 单击“file”菜单中的“creat/update”选项，选择“creat symbol files
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