对2编码器软件设计报告

报告内容报告内容 一一 各类设计环节的性质 目的与任务各类设计环节的性质 目的与任务 本软件设计是一门专业基础实践课 是 C 或 C 语言等课程的后续实践课程 本软件设计的目的和任务 1 使学生全面了解如何应用该硬件描述语言进行高速集成 电路设计 2 通过软件使用 设计与仿真环节使学生熟悉 EDA VHDL 开发环境 3 通过 对基本题 综合题的设计实践 使学生掌握硬件系统设计方法 自底向上或自顶向下 熟 悉 VHDL 语言三种设计风格 并且培养学生应用 VHDL 语言解决实际问题的能力 二二 设计内容 学时分配及基本要求设计内容 学时分配及基本要求 本软件设计安排两周的实践 要求 设计及仿真工具的安装与熟悉 选择并完成一个 基本课题 16 学时 选择并设计一个综合课题 24 学时 三三 课题内容 课题内容 一 基本题 一 基本题 设计一个 4 对 2 编码器 输入 I3 I2 I1 I0 输出 A B 真值表如图 3 I3 I2 I1 I0 A B 0 0 0 1 0 0 1 0 0 1 0 0 1 0 0 0 00 01 10 1 1 图 3 1 对选题的理解对选题的理解 题目要求概述 在数字系统中 常常需要将某一信息 输入 变换为某一特定的代码 输出 把二进 制码按一定的规律排列 例如 8421 码 格雷码等 使每组代码具有一特定的含义 代表某 个数字或是控制信号 称为编码 具有编码功能的逻辑电路称为编码器 编码器有若干个 输入 在某一时刻只有一个输入被转换为二进制码 例如 8 线 3 线编码器和 4 线 2 线编码 器分别有 8 输入 3 位输出和 4 位输入 2 位输出 根据 4 2 编码器的真值表得出逻辑表达 式为 A I2 B I1 I3 2 系统分析系统分析 系统原理图 算法框图 设计要点 难点和特色点 系统原理图 I A 算法框图 Y N Y N Y N Y N 设计要点 难点和特色点 编码器有若干个输入 在某一时刻只有一个输入被转换为二进制码 根据真值表看出 具有一个编码状态的 编码只是完全正确的 但是 对于多个编码状态 则编码是没有意 义的 从中得到一个启示 它的输入中只能有一个被编码信号 也就是说它们之间是有约 束的 而如何正确输入和通过调节时钟显示正确输出是本环节最大难点 3 逻辑仿真图及功能分析逻辑仿真图及功能分析 0010 0 0100 b 1 b 0 10 b 1 b 0 00 开 始 输入信号 a 3 a 2 a 1 a 0 0001 b 1 b 0 01 1000 b 1 b 0 11 输出 b 1 b 0 结果分析 4 2 编码器的逻辑功能就是把输入的每一个高低电平信号编成一个对应的二进 制代码 4 2 编码器有 4 个输入 A0 A3 2 个输出 Y0 Y1 其中任何时刻输入只能有一 个取值为 1 并且有一组对应的 2 进制码输出 4 时序仿真及分析时序仿真及分析 结果分析 将输入时钟调整为 a 3 5ns a 2 10ns a 1 15ns a 0 20ns 后 对照真值表观察 实验数据正确 5 调试过程与问题调试过程与问题 完成代码编写的时刻其实我是激动的 靠自己摸索下调试出了时序仿真图形 但在对 照真值表和代码之后发现无法验证仿真的正确性 又仔细校对了代码仍不正确 在咨询老 师后 将更改为的功能仿真后 结果与真值表和程序相对应 表明程序编写正确 6 体会和建议体会和建议 体会 这是第一次接触 VHDL 语言 通过查阅参考书 从零做起 从实际的题目中一 点一点了解了 VHDL 语言的用法 先理解书上一些实际的例题 然后自己去更改 编写程 序 从而完成了实验课题 只有通过自己动手实验 才能更快的掌握新的知识 才能发现 纯理论学习中发现不了的问题 无论是基本题还是综合题在实验过程中都是遇到了各种各 样的问题 困难重重 通过自己的努力完成这次实验收获还是不小的 建议 增加老师讲解如何使用软件模块 以减少在不必要的地方浪费大量的时间 7 附录 附录 VHDL 源程序 源程序 library ieee use ieee std logic 1164 all entity bm4 2 is port a in std logic vector 3 downto 0 b out std logic vector 1 downto 0 end bm4 2 architecture