时分复用-解复用实验

1、 固定及变速率时分复用、解复用实验 第一部分 固定速率时分复用/解复用实验 亠、 实验目的 1. 掌握固左速率时分复用/解复用的同步复接/分接原理。 2. 掌握帧同步码的识别原理。 3. 掌握集中插入帧同步码时分复用信号的帧结构特点。 二、 实验内容 1. 搭建一个理想信道固泄速率时分复用数字通信系统，使系统正常工作。 2. 搭建一个理想信道固泄速率时分解复用数字通信系统，使系统正常工作。 3. 用示波器观察集群信号（FY_OUT）、位同步信号（BS）及帧同步信号（FS）,熟悉它们的对 应关系。 4 观察信号源发光管与终端发光管的显示对应关系，直接观察时分复用与解复用的实验效果。 三、 实验仪

2、器 示波器.RC-GT-II型光纤通信实验系统。 四、基本原理 1. 同步复接/分接原理 固泄速率时分复用/解复用通常也称为同步复接/分接。在实际应用中，通常总是把数字复接器和 数字分接器装在一起做成一个设备，称为复接分接器（缩写为Muldex）o 分接器 复接游 1 数字复接器的基本组成如图1所示。数字复接器的作用是把两个或两个以上的支路数字信号 按时分复接方式合并成为单一的合路数字信号。数字复接器由定时、调整和复接单元所组成。左时 单元的作用是为设备提供统一的基准时间信号，备有内部时钟，也可以由外部时钟推动。调整单元 的作用是对各输入支路数字信号进行必要的频率或相位调整，形成与本机定时信号

3、完全同步的数字 信号。复接单元的作用是对已同步的支路信号进行时间复接以形成合路数字信号。 数字分接器的基本组成如图1.2所示。数字分接器的作用是把一个合路数字信号分解为原来支 路的数字信号。数字分接器由 同步、左时、分接和恢复单元所组成。立时单元的作用是为分接和 恢复单元提供基准时间信号，它只能由接收的时钟来推动。同步单元的作用是为定时单元提供控制 信号，使分接器的基准时间与复接器的基准时间信号保持正确的相位关系，即保持同步。分接单元 与复接单元相对应，分接单元的作用是把输入的合路数字信号（高次群）实施时间分离。分接器的恢复 单元与复接器的调整单元相对应，恢复单元的作用是把分离后的信号恢复成为

4、原来的支路数字信号。 将低次群复接成髙次群的方法有三种；逐比特复接：按码字复接：按帧复接。在本实验中，由 于速率固泄，信息流量不大，所以我们所应用的方式为按码字复接，下而我们把这种复接方式作简 单介绍。 按码字复接：对本实验来说，速率固立，信息结构固泄，每8位码代表一“码字”。这种复接方 式是按顺序每次复接1个信号的8位码，输入信息的码字轮流被复接。复接过程是这样的：首先取 第一路信息的第一组“码字”，接着取第二路信息的第一组“码字”，再取第三信息的第一组“码字”, 轮流将3个支路的第一组码字”取值一次后再进行第二组“码字”取值，方法仍然是：首先取第 一路信息的第二组码，接着取第二路信息的第二

5、组码，再取第三路信息的第二组码，轮流将3个支 路的第二组码取值一次后再进行第三组码取值，依此类推，一直循环下去，这样得到复接后的二次 群序列（d）。这种方式由于是按码字复接，循环周期较长，所需缓冲存储器的容量较大，目前应用 的很少。 AF1 AF2 AF3 AF4 图13 按码字复接示意图 （a）第一路信息；（b）第二路信息；（c）第三路信息；（d）复接后 2. 本实验所用的同步复接模块的结构原理 本实验所用到的固立速率时分复用端的原理方框图如图1.4所示。这些模块产生三路信号时分 复用后的FY_OUT信号，信号码速率约为128KB,帧结构如图1. 5所示。帧长为24位，其中首位无 左义，第2

6、位到第8位是帧同步码（7位巴克码1110010）,期外16位为2路数据信号，每路8位。 此FY_0UT信号为集中插入帧同步码时分复用信号。同时通过发光二极管来指示码型状态：发光二极 管亮状态表示1码，熄状态表示0码。图1.1数字复接器的基本组成图 1.2数字分接器的基本组成图 1 本实验中用到的电路，除并行码产生器和8选一电路是由分1 立器件组成的外，苴他电路全都在两片大规模集成电路XC95XL144TQ100-5 (以下简称CPLD)内部。 下而对时钟信号源、分频器、八选一、调整器及复接器等单元作进一步说明。 (1)时钟信号源 时钟是由晶振XI (20.48MHz)提供，它也是整个系统的时钟

7、信号源。20.48MHz时钟经CPLD分 频得到本实验所需的时钟信号CLK1, Fc=4. 096KHz. 8位并行码产生器 8位并行码产生黠 8位并行码产生黠 八选一 八选一 |八选 f T T FY IN 帧同步码 冋步保 识别器 护器 图1.13 帧同步电路组成框图 帧同步电路如图1.13可知，整个帧同步电路主要由分频器、帧同步码识别器、脉冲生成器和 同步保护器四大部分组成。各组成电路的作用分别如下： 分频器：主要是将位同步信号进行24分频得到与信源的帧同步信号同频的准帧同步信号，然 后送入脉冲生成器进行相位调整。 帧同步码识别器：从串行信号（FY_IN）识别出同步码（在我们系统中的同步

8、码为：X1110010）, 当识别器识别到一组帧同步码时，它就输出一个脉冲，送入同步保护器：若输入的信号中没有同步 码，则其始终输出低电平。 同步保护器：当没有帧识别脉冲输入时，始终输出一低电平，使脉冲生成器停止工作，这样就 没有FS信号输出；当有连续的识别脉冲输入时，保护器输岀满足时序要求的控制脉冲给脉冲生成器。 脉冲生成器：当分频器和同步保护器都输岀满足要求的时钟信号时，脉冲生成器才输岀正确的 帧同步脉冲；当分频器和同步保护器输出的信号不满足时序要求时，则将输岀错误的FS信号。 3） 延迟器1、2、3,整形器： 通过整形器，则可以将送来的FS信号进行脉冲调整，使其脉冲宽度刚好为8个码元宽度

9、。延 迟器主要是由移位寄存器组成，主要是对整形器送来的帧同步信号进行相位调整，以满足时序的需 要。波形如图1.14所示。 4） 串/并变换： 在FD及FD_7的作用下，串并转换器对输入的数拯信号进行选通转换：当FD为“1”时， 转换器1工作，将第一路数据复原为并行数据并输岀到发光二极管进行显示；当FD_7为“1”时， 转换器2工作，将第二路数据复原为并行数据并输岀到发光二极管进行显示。 FD-7 FD-LS | 1 bd wiRnrmjmjiAnjLMLrwinjinnn 图1. 14 变换后的信号波形 五、实验步骤 （以下实验步骤以1310nm光端机部分讲解，即实验箱左边的模块。1550nm

10、光端机部分与其相同） 1. 固定速率时分复用实验 1）关闭系统电源，将固定速率数字信号源模块中的DI、D2、D3分别接到固定速率时分复用复接 端 D-IN1. D_IN2、 D_IN3o 2）打开系统电源，用示波器双通道分别测量并记录FS、BS、FY-OUT、DI、D2、D3信号波形，比 较波形的对应关系，分析波形和理论是否一致。 2. 固定速率时分解复用实验 1）关闭系统电源，将固左速率时分复用复接端接口 FY_OUT接到固立速率时分复用分接端接口 FY_INo 2） 将D3端口所对应的八位拨码开关拨成帧同步码（7位巴克码1110010）o 3） 打开系统电源，观察实验结果，分析能否正常解复

11、用。 3. 实验所需端口说明 DI、D2、D3：固左速率数字信号源输出端口 D_IN1、D_IN2、D_IN3：复用模块数字信号输入端口 FY-OUT：复用模块信号输岀端口 FY-IN：解复用模块信号输入端口 BS：位同步信号输出端口 FS：帧同步信号输出端口 六、注意事项 1. 该实验设备系采用元件表面贴装方式制造，务必注意不能让金属导电物体掉落在电路板上（特 别注意示波器地线夹），否则极易烧毁设备。 2. 进行接线操作前必须先关闭电源（在箱体外部右侧），接线操作完成后检查无误再打开电源， 不可带电插拔各类导线。 3. 夹示波器的地线夹时要注意看清GND地线标识，有的测试接线端子外形与地线端

12、子相同，要 谨防夹错，造成不必要的电路损坏。 七、实验结果 (1)原数据： D1:11110000 D2:00001111 D3:01110010 码宽：32us 码速：31.25Kbps 示波器显示: D3 j i n | i i n D2 | _ DI I I FY_OUT 帧同步码 D2 1 DI 1 1 1 I 1 1 1 i 1 FS | BS jwjwinfL 第二部分 变速率时分复用/解复用实验 一、 实验目的 1. 掌握变速率时分复用的码速率调整原理。 2. 掌握变速率时分复用的复接/分接原理 3. 掌握逐比特复接的复接/分接原理。 二、 实验内容 1. 认真学习实验指导，学习

13、时分复用的异步复接/分接原理。 2. 搭建变速率时分复用/解复用实验连接电路。 1 3. 用示波器观察输入信号、调整速率后的信号、复接时钟信号，复接后的信号及分接后的信号, 了解它们的对应关系。 三、 实验仪器 示波器，RC-GT-II型光纤通信实验系统。 四、 基本原理 1. 变速率复接电路原理 变速率复接电路组成框图如图2.1所示。 图2复接电路组成框图 各组成模块的功能说明如下： 线路编码器（前4个）：把被复接的4个不同速率数据编码成具有相同标称速率的信号。 正码速调整：进行码速调整，即把4个标称速率相同实际有容差的的信号都调整到同一速率上, 使它们同步。 位同步复接器：将4个支路已经同

14、步的信码流复接成一个高速率的二次群信号。 线路编码器（最右边一个）：对复接后的信号进行编码，以便在接收端提取时钟。 在实验一中我们已经知道数字复接由数字复接器（Digitalmultiplexer）和数字分接器两部分组成， 且数字复接器是将同步的多路信号复接成一路信号，在本实验中，我们将讨论如何将异步的多路数 字信号复接成一路信号，即异步复接。 那么什么是异步复接呢？当输入支路数字信号不同步而与本机立时信号是异步的，即它们的对 应生效瞬间不一左以同一速率岀现，那么调整单元就要对各个支路数字信号实施频率和相位调整， 使之成为同步信号，这种复接称为异步复接，这种复接器称为异步复接器。还有两种情况，

15、即：如 果输入支路数字信号的生效瞬间相对于本机对应的左时信号是以同一标称速率岀现，而速率的任何 变化都限制在规左的容差范国内，这种复接称为准同步复接，这种复接器称为准同步复接器；如果 被复接的各支路数字信号的时钟源是各自独立的，尽管它们的标称码 率都相同，并允许在规左的容 差范朗内变化，这种准同步复接一般又称为异源复接。具有相同标称速率但不是由同一时钟源产生 的两个信号通常就是准同步的。 2. 正码速调整原理： 在实验一中的三路信号（DI、D2、D3）复接时，由于各路是使用同一个时钟源，且频率、相位相 同，是同步复接，因此实现起来较为简单。 然而，在系统中，若要对四路不同计算机的串口数据进行复

16、接，由于它们各自通信时的波特率 不同，所以对它们进行复接，应分三个步骤来进行：第一步将各输入信号进行编码，使它们速率的 标称值相同：第二步将各支路的编码后的信码变换成与一个标准信号同频同相的信码，即先对各支 路进行码速调整，使之达到码速同步：第三步进行同步复接，即将已同步的数码进行复接。后两个 步骤组合起来就称为准同步复接，实现准同步复接，其重要概念是；先进行码速调整，再进行同步 复接。码速调整为同步复接提供条件。 码速调整有三种方式：正码速凋整；正/负码速调整；正/零/负码速调整。 ITU-T推荐使用正码速调整和正/零/负码速调整方式。我国大部分复用设备采用正码速调整 方式，也有采用正/零/

17、负码速调整方式的。目前应用的多是“脉冲插入同步”方式，这种方式是 利用插入脉冲的方法来实现调整的。 所谓正码速调整就是将被复接的低次群的码速都提髙，使其同步到某一规左的较高的码速上。 例如在PCM基群的数码率标称值都是2 048kb/s,但由于各个独立的时钟源总是存在偏差，因此， 可根据复接帧的要求，确泄脉冲的插入数目，使每个基群的数码率均由2 048kb / s填充到所要求的 数码率，二次群复接时为2112kb/s。这样，码速都提高了，又达到了相互同步的目的。由于是用提 高码速来使其同步，故称为正码速调整。 在系统中，首先对输入的四路信号按一立速率进行编码，以便使四路信号速率的标称值相同，

18、编码方式可以采用多种方式（如CML DML 5B6B, 4B1H等等），然后再对编码后的信号进行脉冲 插入同步的正码速调整，下面，我们对正码速调整中插入脉冲部分的原理作简单介绍。1 釆用脉冲插入同步的正码速调整的原理如图2.2所示。该图只绘出一个支路的码速调整插入部 分情况，去插入部分和复接部分没有绘出。 图2.2脉冲插入同步方式插入部分的原理示意图 方框图：（b）支路输入数码流予，（c）码速调整后的数码流一刨： 基群输入的数字信号先写入到一个缓冲存储器，写入速率是编码速率，读出时钟频率则是码速 调整后的速率加，而阿,所以存储器是读得快写得幔，即存储器处于“快读慢写”状态。快读幔 写会出现什么

19、结果呢?从图中可以看出，第1个脉冲经过一段时间后读出，第2个脉冲的读岀，其经 过的时间长度比前者要短一些，因读出速度比写入速度快，以后的写入与读出时间差，即相位差愈 来愈小，在第6个脉冲时两者相位差已很小，即将出现取空状态，当相位差小到一泄程度时，由相 位比较器（在缓冲存储器中）发出插入请求，要求插入脉冲控制电路发岀一个插入指令，停止一次读岀, 同时在此瞬间插入一个脉冲，如图中虚线位宜所示。 插入脉冲是不携带信息的，所以在接收端应把它去掉，为此，发送端在插入脉冲的同时，必须 发出一个标志信号通知接收端，据此判别出哪些是插入脉冲，然后把它去掉以恢复原始信号。 正码速调整过程的要点如下： a） 输

20、入的数码流以予的速率写入缓冲存储器：缓冲存储器以M的速率读出，即进行快读慢写。 b） 当读时钟与写时钟的相差小到某一规左值时，由鉴相器检出其状态，要求插入脉冲控制电路 发出一个指令，此指令控制三个动作：停止一次读出：插入一个脉冲，给插入脉冲作出标志。 c） 4个基群支路的速率都正调整到予“后，再复接成二次群。即予一加X4-纱尬 以上就是系统所采用的码速率调整部分、逐比特同步复接的原理介绍，通过这两部分的协同工 作，就可以将输入的四路异步信号复接成一路串行信号进行传输 3. 变速率分接电路原理 分接端的原理框图如图2.3所示。写入时钟 写读 入出 、信息信道 如读岀时钟 贮存状 态检测 插入 指

21、令 (b) 5 6 7 8 9 10 11 12 I J, Il J 脉冲 抽入 馱冲 1 图2.3 分接电路原理框图 各组成模块的功能说明如下： 泄时提取：从输入信号中提取泄时信息，为其他模块提供时钟。 线路译码(最左边一个)：在时钟作用下，对输入信号进行译码，同步，最后供给分接器和去插 入控制器。 分接器：把二次群数码流分接成4组，分路送入缓冲存储器。 缓冲存储器：在进行读、写时有一左的存储缓冲作用，分接侧的缓冲存储器与复接侧的缓冲存 储器大体相同，所有不同是分接侧的缓冲存储器不包括相位比较器，比相工作由锁相环完成。 分接泄时器：为缓冲存储器提供一个已扣除插入脉冲的写脉冲。 去插入控制器：

22、提供一种控制，通过它的控制把接收的数码流中的插入脉冲去掉。首先由它检 出插入标志信号脉冲，经过择多判决，如果判断出接收数据流中有插入脉冲，就进行消插，将插入 脉冲去掉。 锁相环：为缓冲存储器提供读出时钟。 去插入原理示意图如图2.4所示。在接收端，当收到发送端的标志信号后，它连同信号一起通 过一个标志信号检出电路而被检出，因而产生一个“消插指令”，把写入脉冲禁掉一个，也就是不使 插入脉冲写入存储器。如图(c)所示，即原虚线所示的位宜空着了。这时，数码与原来的数码次序一 样(因已扣除了插入脉冲)，但时间间隔是不均匀的，中间有间隙。因此，在接收端，要恢复原数码, 必须从图(c)波形中，提取时钟予，

23、即是将已去掉插入脉冲的数码流均匀化。这一任务用一个锁相环 来完成。 锁相环框图如图2.5所示。由鉴相器、压控振荡器和低通滤波器组成*压控振荡器的输出是读 岀时钟予；相位为鉴相器有两个输入信号：一个是写入时钟力，它是已扣除插入脉冲的序列， 其相位为()诂另一个是压控振荡器的输出仏 鉴相器将两信号进行相位比较，町-IN L 3 定时提収| T 分接定时器I |_ _ A0UT1 口缓冲存倚| - T 线路译码|_I I r 锁相环 缓冲存储| - - - - 锁相坏 A0IT2 A0LT3 T 线路译码一 I 锁相环 A01T4 口缓冲存储 I | |_想 | C 1 HI 1 线路铎码 1 标志

24、信号 数据佶道 图2.4 同步脉冲去插入原理示意图 (a)方框图；(b)码速调整后的数码流声： (c)扣除插入脉冲后的接收信号；(d)恢复后的原数码流方 鉴相器的输出电压ud与它们的相差0 e成比例， 经过低通滤波器滤出的直流成分uc,即为其平均值。 uc作为VCO的控制电压，通过环路的作用，使fi与fm同步，即振荡器振荡在平均频率fi上，使读 出脉冲的间隔均匀了。 抑除 心入I I 1 I i I I丨丨I I ft 3 心出)i I丨1 I I丨I I丨i I 信息信道句 足时 再生 (a) 匚入 时仲 吗读 入出 、/ 7 刃 VCO 1 图2.5收端读出脉冲均匀化 (a)(a)力皿已扣

25、除塞入脉冲)；(b)(写入)；(c)卅读出)；(d)血三矽 为了使塞入脉冲的塞入和去塞入更可靠一些，往往采用左位塞入法。而塞入脉冲的标志信号往 往是与帧同步信号一起传送，这时数据信道与信息信道合成为一个信道。综上所述，接收端工作过程要点如下： 1） 泄时再生电路再生予“，作为写入时钟。 2） 由插入脉冲检测电路检测岀插入脉冲后，发出扣除插入脉冲指令，把写入脉冲禁掉一个， 即不使插入脉冲写入存储器。 3） 将已扣除塞入脉冲的fm送到锁相鉴相器，通过锁相环的作用，获得读出时钟fi,即恢复 为原来支路的频率fi。 4） 由于锁相环的存在，不可避免要产生抖动。 五、 实验步骤 （以下实验步骤以1310nm光端机部分讲解，即实验箱左边的模块。1550nm光端机部分与其相同） 1. 变速率时分复用实验 1） 关闭系统电源，任取4路数字信号分别接到AIN1. AIN2. AIN3、AIN4进行四路数据的复接。 2） 打开系统电源，通过示波器双通道观察原始信号与复接信号的