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文档简介

1、FPGA/CPLD应用技术应用技术温国忠温国忠 、余菲、曾启明、余菲、曾启明晏凯、刘俐晏凯、刘俐自动售货机设计自动售货机设计分频器模块设计分频器模块设计曾启明曾启明 博士博士电子邮件：电子邮件：电话：电话频器原理所谓分频器，就是用较高频率的时钟进行分频操作，得到较低频率的信号，一般实现可通过计数器实现。即用一个频率较高的时钟进行计数，计数到某一个固定值进行跳变，就能够获得一个频率较低的时钟。计数器分频器由50Mhz时钟产生10KHz时钟的功能，原始的未分频时钟是50Mhz，根据计算公式：n=T/2t，令n=5000，也就是每次计数5000个原始时钟周期以后就把输出的分

2、频时钟信号翻转一次，输出时钟频率为10Khz。分频器模块设计信号名I/O位宽含义clkI1 bit系统50Mhz时钟输入clk1O1 bit分频后频率为10Khz的时钟输出module clk_div(clk, /输入时钟clk1 /输出时钟);input clk;output clk1;reg12:0 counter; /定义计数器来计数时钟，计数5000，需要用13位计数器reg clk1;always(posedge clk)if(counter=13d5000) /如果等于5000begincounter = 13b1; /把counter恢复成1clk1 = clk1; /把clk1翻转endelse /如果不等于5000 counter = counter +

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