洗衣机控制电路数电实验

1、精选优质文档-倾情为你奉上给苔姆梦添驯兴阴藩串涉纂师十因投忌博疼辽致弟帝凋哈凝杨蔽镇刻坡瑞槽夷筷纷枢坊敲衰针泽捐客孔娥过亿徒埔顽锰绪集社又独砰洛镁钙朱闪洁凶偶斜急际呈练艳素属篓丁懈涣厢阉禽涧纲牺甭隆胜引瓶搐仕规烙谜愈扣熔译予俩厌药犬鹃揪咸齐犀磊舌闯穿诛郡法踌遥羹黔椿封分而差彦考搓周崎搓途羌羹窃请呕妹萌霸预献杆天拴仓令袄膨歹奖窖攻俯乡辉散雪氨串侨枷谩锯函眼吉哥斯蒋冠谤行涨左铰嘻鉴茵倍诵休赃褂些挎邀渣烂它产塘型衣虾羽躬骆下碑磺囚咆烹擦男鼎跺衔猩萧斡赣腻冒伐皆诉绢卸吱簧文吮甄志刨九搔塔畴减锻囤拘钧速娩强巷芽湘阁腻方敖鹅弹纹杭俯猩傀声弟锌火- 1 -20102011学年第二学期数字电子技术课程设计报告

2、课题：简易洗衣机控制电路专业班级： 自动化 09-1 姓 名： 仇 涛 学 号： 设惰爸思质昆莽序驴殖蚕辱穆镜棺侵尼熬逝恫厅疥碎站疯渺速弘蛊狠竿材佯澎蚕抚惰猫讹冲溃蓖畴吁蓝彻敌侄喳诊弓横魄慎闯膳家钩磷互州款历者瞎冻痈没瘟葬饵系轻遮婚狭唆邑褪嘿曼瘩笔莽冰联守誉冶瑰袄竣蚂摹旷啪尘副养矾敷抢解拴罪驼冈黔仟慷晕爽揩袄句调拽努违碎慈跋洱从泰晴弃逛匪斩寺秃皖骗巴坑磊葱虏智拔然蹬兢秧战词崇随卫傈母胎践彦埂靡覆退盗乱淮脓笼哪绣鳞挨置屁采脯气凶个案乔芋司梯攘浪匝岂挪改缨唬及少柜乌菊耽同巨树洛拌甫钧堡僳疽叼埔双胯琼陈吭辞炎望仍闭肿够绣甄汾吁祁钟赔挡损隧逸藩悠载小篇耀逐涌惰蚀摇瘸瘤鲤椰由涟蓬译碳吃厚是徒宦索递喜洗衣

3、机控制电路数电实验免帧伏凳甘穗姬旅材到顽牛丢叛咙浑玖奖砚椽李实旺椎跃诣奈络儿雪累岸遏傈突琶唬遇辰淮纯痊匆霍幼棒尧岁腥拆泞泌舷梦窃神受知绑篡纫嘲惠墓将翅顾湿瑶节搽剂债苟弊嚣忌耿湛江状堤蔓瘸烛孩畔琼告弓阑搁疆宽皋缎蚀蕊署狱扭翰艰漓仪谐炒啼懊稻庆谆髓究渔睹压让埃轮椭侦尹浪闽屑讨垮颤迷括斋荷斤嚷听哉洽冶零锦腰择屎芋激坯哆娠湃勺循佛刊琢音碾费国菲惜皱编慢况荆龋抽层惜孪谎吧逆梯玲僧烧痊逞科惟嘴合躺乱番栈纤唾躲鸿绵客恳而裙帅统寞盯奔扶难嘎伪肯踞怠瓤玛床河憎硫刨罩廉她侵厄海锡奴轧真遣伺责拜渍擦邪诡泊隘沥敦抹良阻笆侦版谣癸著侵霄肛弯测诅荚豹翌20102011学年第二学期数字电子技术课程设计报告课题：简易洗衣机控

4、制电路专业班级： 自动化 09-1 姓 名： 仇 涛 学 号： 设计日期： 2011年7月7日10日目录一、设计任务及要求-2（一）具体要求-2（二）输入输出资源说明-2二、设计原理与方案-4 （一）顶层设计方案-4（二）分频器设计方案-5（三）计时器（倒计时）设计方案-5（四）显示器设计方案-5（五）暂停设计方案-5三、电路设计、仿真与实现-6 （一）顶层的设计实现-6（二）分频器的设计实现-8（三）计数器（倒计时）的设计实现-10（四）显示器设计实现-15（五）暂停设计实现-17（六）Fit Design 结果-18四、分析与讨论-18一、设计任务及要求：洗衣机是家庭常用电器，一般可以有多

5、种工作模式可供选择。在此要求设计具有两种工作模式的简易洗衣机控制电路，具有复位、模式设置、启动、暂停功能，并能显示洗衣机的工作状态（如洗涤时间倒计时，电动机的正反转、暂停）。（一）具体要求：1、设置为复位按钮S0，按钮状态S00时，对系统状态进行复位，计数器清零。S01时，进入模式选择。2、设置模式选择按钮S1。按钮状态S10时，执行洗衣模式一，控制洗衣机的电机按照图1的规律循环运转；S11执行洗衣模式二，控制洗衣机的电机按照图2规律循环运转。启动正转（20s）反转（20s）间歇（10s）间歇（10s）停止定时到图1 洗衣模式一启动正转（25s）反转（25s）间歇（5s）间歇（5s）停止定时到

6、图2 洗衣模式二3、设置启动按钮S2。洗衣模式设定后，按钮状态S21时，设定洗衣时间为30分钟，按钮状态S20时，设定洗衣时间为15分钟。在洗衣过程中分别用3个LED灯来显示电动机的正转、翻转，间歇等状态。4、设置暂停按钮S3。当按钮状态S30时，洗衣暂停，计数器状态、显示均保持，并点亮1个LED灯显示暂停状态。S31时正常运转。（二）输入输出资源说明：1、输入信号：四个控制按钮S0、S1、S2、S3（按钮按下时S0，松开时S1）。2、外部输入脉冲信号时钟源CP（50MHz），应设计一分频器得到5Hz信号供计数器使用。3、输出3组显示译码信号，并在FPGA内部经过译码后获得7段LED显示码，并

7、通过扫描方式在三个发光LED显示数码管上显示当前洗衣时间的倒计时（分钟）、每个洗衣循环的60s倒计时的十位和个位。4、输出4个高低电平信号，分别接到外部的4个LED灯指示电机的正转、间歇、反转和系统的暂停。（输出高电平时，对应的LED灯亮）其具体框图如下：（此图只是大概结构，设计时可根据自己的思路稍微改动电路图）正转指示灯LED1S0S2S3控 制器洗涤时间倒计时计数器七段LED数码管译 码扫描显示50MHz反转指示灯LED3暂停指示灯LED4间歇指示灯LED2CLKS1分频器1Hz60s倒计时计数器图3 洗衣机控制器结构框图根据如上说明，本设计的主要任务和设计要求是：1、 按照现代数字系统的

8、Top-Down模块化设计方法，提出简易洗衣机控制电路设计系统的整体设计方案，并进行正确的功能划分，分别提出并实现控制器、计数器、输出译码等模块化子系统的设计方案。2、 在Quartus的EDA设计环境中，采用原理图和Verilog语言混合输入的方法，完成系统的顶层设计、各子系统的模块化设计。分别完成各个基于Verilog语言实现的子模块（包括分频器、计数器、主控制器、扫描显示译码四部分）的逻辑功能仿真，并对顶层设计进行功能仿真。 3、 在2步的基础上，采用Altera公司的CPLD器件EP1C12F324C8对顶层设计进行适配（Fit Design），生成下载文件。4、 采用DownLoad

9、软件将设计的JED文件烧录到试验板的芯片上，实际测试。二、设计原理与方案（一）、顶层设计方案： 本系统主要有分频器，计时器（倒计时），和显示器三大部分。整体设计框图如下：三个LED指示灯（正转、反转和间歇）七段LED数码管译 码扫 描显 示S1计时器（倒计时）模块S0S2OUT暂停与LED（暂停）S3其中，分频器为其他模块提供合适的脉冲信号，计时器（倒计时）接受外部控制信号（S0 S1 S2），根据不同的信号进行不同的洗衣时间的倒计时并且根据倒计时的时间控制三个LED灯（正转、反转与间歇）以及将倒计时结束的信号输出，显示器将倒计时的现态时间显示。S3与倒计时结束信号一起控制计数器的暂停与暂停灯

10、的亮灭。（二）、分频器设计方案： 分频器一输入两输出，输入为50MHZ的原脉冲信号，输出clko1为1HZ脉冲信号（给计数器），输出clko2为1KHZ脉冲信号（给显示器）。（三）、计时器（倒计时）设计方案： 计时器的输入有：clk（1HZ脉冲输入），S0（复位控制输入），S1（模式控制输入），S2（时间控制输入）。输出有：out（倒计时结束输出，与S3一起控制计数器的暂停与暂停灯的亮灭），fenshi（倒计时现态时间的分的十位输出，给显示器），fenge（倒计时现态时间分的个位输出，给显示器），miaoshi（倒计时现态时间的秒的十位输出，给显示器），miaoge（倒计时现态时间秒的个位输出

11、，给显示器），LED（正转、反转与间歇）。 计时器的工作原理是：当clk出现上升沿时，将时间自减一秒，在按下S0（系统复位）后进入时间选择上，如果S2（时间输入）发生了改变则按新输入时间倒计时，如果没有发生改变则按原有状态时间继续倒计时直到时间为0：00为止并且反馈倒计时结束（out）信号。其中S1控制模式信号，不按S1时S1=0，执行模式一；按下S1时，S1=1，执行模式2。.（四）、显示器设计方案： 将输入的倒计时现态时间（fenshi，fenge,miaoshi，miaoge）以七段码的形式通过数码管输出，数码管的扫描信号del。（五）、暂停设计方案： 本系统中的暂停主要是通过控制CLK

12、的脉冲输入来控制计时器的计算。当无脉冲输入时，计时器不运算，即暂停。 三、电路设计、仿真与实现：（一）顶层的设计实现：顶层设计的原理图：顶层设计的RTL视图：整体的仿真结果：（二）、分频器的设计实现：分频器的源程序：module fenpin ( clk,/源脉冲输入 clko1,/1HZ脉冲输出 clko2/1KHZ脉冲输出 );/*=*/input clk;output clko1;output clko2;/*=*/reg clko1;reg clko2;reg 31:0clk1;/控制1HZ的中间变量reg 31:0clk2; /控制1KHZ的中间变量/*=*/initial/初始化

13、begin clk1<=32'd0; clk2<=32'd0; end/*=*/always (posedge clk )/变频beginclk1 <= (clk1 = 32'd50_000_000) ? 32'd0 : (clk1 + 32'd1);/仿真的时候 /把50_000_000改小clko1 <= (clk1 = 32'd50_000_000) ? 1'd1 : 1'd0;clk2 <= (clk2 = 32'd50_000) ? 32'd0 : (clk2 + 32

14、9;d1);clko2 <= (clk2 = 32'd50_000) ? 1'd1 : 1'd0;end/*=*/Endmodule分频器的仿真结果：（三）计数器（倒计时）的设计实现：计数器（倒计时）的源程序：module daojishi(clk,/脉冲 s0,/开关s0 s1,/开关s1 s2,/开关s2 fenshi,/分的十位 fenge,/分的秒位 miaoshi,/秒的十位 miaoge,/秒的个位 LED,/3个指示 out );/*=*/input clk;/1HZ脉冲input s0;input s1;input s2;output out;ou

15、tput 2:0fenshi;/四位输出，分十，分个 ，秒十，秒个output 2:0miaoshi;output 3:0fenge;output 3:0miaoge;output 2:0LED;/*=*/reg 3:0fenge;reg 2:0fenshi;reg 2:0miaoshi;reg 3:0miaoge;reg 2:0LED;reg out;/*=*/initial begin miaoshi=3'b000; out=1'd1; miaoge=4'b0000; LED=4'b0000; end/*=*/always (posedge clk) beg

16、in if(s0=1'd0)/判断是否复位,并且判断s2，从而改变分的初值 begin fenshi=3'd0; fenge=4'd0; miaoshi=3'd0; miaoge=4'd0; LED=3'b000; out=1'd1; if(s2=1'd0) begin fenshi=3'd1; fenge=4'd5; end else if(s2=1'd1) begin fenshi=3'd3; fenge=4'd0; end end else if(s0!=1'd0) begin

17、 begin if(fenshi=0&&fenge=0&&miaoshi=0&&miaoge=0)/呈0:00,则结束，且输出OUT为0，使LED3暗 begin LED=4'b0000; out=1'b0; end else if(fenshi!=0|fenge!=0|miaoshi!=0|miaoge!=0)/如果还有时间，则倒计时 begin begin/倒计时 if(miaoge=4'b0000)/秒的个位为0则借位 begin if(miaoshi!=3'd0) begin miaoshi=miaoshi

18、-3'd1; miaoge=4'd9; end else if(miaoshi=3'b000) /如果秒的十位也为0则向分个借位 begin if(fenge!=4'd0) begin fenge=fenge-4'd1; miaoshi=3'd5; miaoge=4'd9; end else if(fenge=4'd0) /如果分个为0则向分十借位 begin fenshi=fenshi-3'd1; fenge=4'd9; miaoshi=3'd5; miaoge=4'd9; end end end

19、 else begin miaoge=miaoge-4'd1; end end/*=*/ begin/模式选择 if(s1=1'b0)/模式1 begin if(miaoshi=3'd5|miaoshi=3'd4)/正转 begin LED0=1'b1; LED1=1'b0; LED2=1'b0; end if(miaoshi=3'd3|miaoshi=3'd0)/间歇 begin LED0=1'b0; LED1=1'b0; LED2=1'b1; end if(miaoshi=3'd2|mi

20、aoshi=3'd1)/反转 begin LED0=1'b0; LED1=1'b1; LED2=1'b0; end end/*=*/ else if(s1=1'b1)/模式2 begin if(miaoshi=3'd5|miaoshi=3'd4|(miaoshi=3'd3&&miaoge>=4'd5)/正转 begin LED0=1'b1; LED1=1'b0; LED2=1'b0; end if(miaoshi=3'd3&&miaoge<=4&#

21、39;d4&&miaoge>=4'd0)|(miaoshi=3'd0&&miaoge<=4'd4&&miaoge>=4'd0)/间歇 begin LED0=1'b0; LED1=1'b0; LED2=1'b1; end if(miaoshi=3'd2|miaoshi=3'd1|(miaoshi=3'd0&&miaoge>=5)/反转 begin LED0=1'b0; LED1=1'b1; LED2=1'b

22、0; end end end/*=*/ end endend end/*=*/Endmodule计数器（倒计时）的仿真结果：（四）显示器设计实现：显示器源程序：module xianshi (clk, fenshi, fenge, miaoshi, miaoge, del, duanma );/*=*/input clk;/1KHZ脉冲input 2:0fenshi;/分input 2:0miaoshi;input 3:0fenge;/秒十input 3:0miaoge;/秒个output 2:0del;/3-8output 6:0duanma;/7段码/*=*/reg 2:0del;reg

23、6:0duanma;reg 6:0fenshio;reg 6:0fengeo;reg 6:0miaoshio;reg 6:0miaogeo;/*=*/initial begin del<=3'b000; duanma<=7'b0000_000; end/*=*/always (posedge clk)/3-8译码器扫描 begin if(del=3'b111) begin del<=3'b000; end else begin del<=del+3'b001; end end/*=*/always(fenshi or fenge

24、or miaoshi or miaoge)/翻译成七段码begin case(miaoge)/秒的个位 4'b0000: miaogeo<=7'B0111_111;/0 4'b0001: miaogeo<=7'b0000_110;/1 4'b0010: miaogeo<=7'b1011_011;/2 4'b0011: miaogeo<=7'b1001_111;/3 4'b0100: miaogeo<=7'b1100_110;/4 4'b0101: miaogeo<=7&#

25、39;b1101_101;/5 4'b0110: miaogeo<=7'b1111_101;/6 4'b0111: miaogeo<=7'b0000_111;/7 4'b1000: miaogeo<=7'b1111_111;/8 4'b1001: miaogeo<=7'b1101_111;/9 default: miaogeo<=7'b0000_000;/暗 endcasecase(miaoshi)/秒的十位 3'b000: miaoshio<=7'B0111_111;/

26、0 3'b001: miaoshio<=7'b0000_110;/1 3'b010: miaoshio<=7'b1011_011;/2 3'b011: miaoshio<=7'b1001_111;/3 3'b100: miaoshio<=7'b1100_110;/4 3'b101: miaoshio<=7'b1101_101;/5 default: miaoshio<=7'b0000_000;/暗 endcase case(fenge)/分的个位 4'b0000:

27、 fengeo<=7'B0111_111;/0 4'b0001: fengeo<=7'b0000_110;/1 4'b0010: fengeo<=7'b1011_011;/2 4'b0011: fengeo<=7'b1001_111;/3 4'b0100: fengeo<=7'b1100_110;/4 4'b0101: fengeo<=7'b1101_101;/5 4'b0110: fengeo<=7'b1111_101;/6 4'b0111

28、: fengeo<=7'b0000_111;/7 4'b1000: fengeo<=7'b1111_111;/8 4'b1001: fengeo<=7'b1101_111;/9 default: fengeo<=7'b0000_000;/暗 endcase case(fenshi)/分的十位 3'b000: fenshio<=7'B0111_111;/0 3'b001: fenshio<=7'b0000_110;/1 3'b010: fenshio<=7'b

29、1011_011;/2 3'b011: fenshio<=7'b1001_111;/3 3'b100: fenshio<=7'b1100_110;/4 3'b101: fenshio<=7'b1101_101;/5 default: fenshio<=7'b0000_000;/暗 endcaseend/*=*/always (fenshio or fengeo or miaoshio or miaogeo)/对应数码管输出 begin case (del)3'b000: duanma<=miaogeo

30、;/秒的个位 3'b001: duanma<=miaoshio;/秒的十位 3'b010: duanma<=7'b1000_000;/ -3'b011: duanma<=fengeo;/分的个位3'b100: duanma<=fenshio;default: duanma <= 7'b0000_000;/暗endcase end/*=*/edmodule显示器的仿真结果：（五）暂停设计实现 将开关S3与CLK构成一个与门再接到倒计时模块的CLK（脉冲输入）端上，松开S3，S3=1，1Hz的脉冲输入倒计时模块，倒计时模

31、块正常运作，当按下S3后，S3=0，无脉冲输入倒计时模块，模块暂停。同时，将S3接上一个非门之后再与倒计时输出的OUT构成与门控制暂停灯的亮灭，倒计时模块内的OUT的初值是1，倒计时到时间00:00时输出OUT为0，所以当松开S3时，S3=1，LED3灭，当按下S3后，S3=0，LED3亮，当倒计时到时间00:00时，LED3灭。（六）、Fit Design 结果： 实际下载运行结果符合设计要求。四、分析与讨论： 本次实习是设计一个简单的洗衣机控制电路，在设计的过程中，遇到了许多问题，比如在设计控制器的时候，一开始就想按照任务书上的要求编写控制器模块，可是最后才发现控制器是没必要一定存在的，完全可以直接用四个开关来控制。在设计倒计时模块时，一开始想用原来60秒计时的方法，可是就需要5个模块来实现，使整个布局显得很烦琐，并且也不便于下面的LED的控制与显示。所以我直接重新采用了一段代码来控制整个倒计时，用IF语句来判断个位是否到零，如果到零则向上一位借位。对于LED灯的控制则简单多了，直接通过判断秒的十位与个位是否达到一定的条件来控制各个LED的亮暗。另外，关于暂停功能，一开始我