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PAGE第4页共4页考生信息栏系专业级班级姓名学号装订线厦门理工学院试卷2009-2010学年第1学期课程名称计算机组成原理试卷卷别AB□计算机科学与技术(专升本)专业2009级班级考试方式闭卷开卷□本试卷共七大题(3页),满分100分,考试时间120分钟。请在答题纸上作答,在试卷上作答无效。选择题:(本题共19小题,每题1分,共19分)1
某机字长64位,1位符号位,63位表示尾数,若用定点整数表示,则最大正整数位(
)。A
+(263-1)
B
+(264-1)
C
-(263-1)
D
-(264-1)2
请从下面浮点运算器中的描述中选出两个描述正确的句子(
)。
A
浮点运算器可用两个松散连接的定点运算部件阶码和尾数部件来实现。
B
阶码部件可实现加,减,乘,除四种运算。
C
阶码部件只进行阶码相加,相减和比较操作。
D
尾数部件只进行乘法和除法运算。3
存储单元是指(
)。
A
存放1个二进制信息位的存储元
B
存放1个机器字的所有存储元集合
C
存放1个字节的所有存储元集合D
存放2个字节的所有存储元集合4
某机字长32位,存储容量1MB,若按字编址,它的寻址范围是(
)。
A
0~1M
B
0~512KB
C
0~256K
D
0~256KB5
用于对某个寄存器中操作数的寻址方式为(
)。
A
直接
B
间接
C
寄存器直接
D
寄存器间接6
程序控制类的指令功能是(
)。A
进行算术运算和逻辑运算B
进行主存与CPU之间的数据传送C
进行CPU和I/O设备之间的数据传送D
改变程序执行的顺序7
指令周期是指(
)。A
CPU从主存取出一条指令的时间B
CPU执行一条指令的时间C
CPU从主存取出一条指令加上执行一条指令的时间
D
时钟周期时间
8发生中断请求的条件是(
)。A
一条指令执行结束B
一次I/O操作结束C
机器内部发生故障
D
一次DMA操作结束9
中断向量地址是(
)。A
子程序入口地址B
中断服务程序入口地址C
服务程序入口地址指示器
D
例行程序入口地址10直接映射cache的主要优点是实现简单。这种方式的主要缺点是(
)。A
它比其他cache映射方式价格更贵B
如果使用中的2个或多个块映射到cache同一行,命中率则下降C
它的存取时间大于其它cache映射方式D
cache中的块数随着主存容量增大而线性增加11从器件角度看,计算机经历了五代变化。但从系统结构看,至今绝大多数计算机仍属于(
)计算机。A
并行
B
冯·诺依曼
C
智能
D
串行12
以下有关运算器的描述,(
)是正确的。
A
只做加法运算
B
只做算术运算
C
算术运算与逻辑运算
D
只做逻辑运算13常用的虚拟存储系统由(
)两级存储器组成,其中辅存是大容量的磁表面存储器。
A
cache-主存
B
主存-辅存
C
cache-辅存
D
通用寄存器-cache14RISC访内指令中,操作数的物理位置一般安排在(
)。A
栈顶和次栈顶
B
两个主存单元C
一个主存单元和一个通用寄存器
D
两个通用寄存器15当前的CPU由(
)组成。A
控制器
B
控制器、运算器、cacheC
运算器、主存
D
控制器、ALU、主存
16在集中式总线仲裁中,(
)方式响应时间最快。
A
独立请求
B
计数器定时查询
C
菊花链17CPU中跟踪指令后继地址的寄存器是(
)。
A
地址寄存器
B
指令计数器
C
程序计数器
D
指令寄存器18从信息流的传输速度来看,(
)系统工作效率最低。
A
单总线
B
双总线
C
三总线
D
多总线19单级中断系统中,CPU一旦响应中断,立即关闭(
)标志,以防止本次中断服务结束前同级的其他中断源产生另一次中断进行干扰。
A
中断允许
B
中断请求
C
中断屏蔽
D
DMA请求
二、填空题(每个空格1分,共18分)1
直接使用西文键盘输入汉字,进行处理,并显示打印汉字,要解决汉字的(
)、(
)和(
)三种不同用途的编码。2
数的真值变成机器码时有四种表示方法,即(
)表示法,(
)表示法,(
)表示法,(
)表示法。3
主存储器的技术指标有(
),(
),(
),(
)。4
某系统总线的一个存取周期最快为3个总线时钟周期,总线在一个总线周期中可以存取32位数据。如总线的时钟频率为8.33MHz,则总线的带宽是(
)。5字符信息是符号数据,属于处理(
)领域的问题,国际上采用的字符系统是七单位的(
)码。6CPU从内存取出一条指令并执行该指令的时间称为(
),它常用若干个(
)来表示。7
衡量总线性能的重要指标是(
),它定义为总线本身所能达到的最高传输速率,单位是(
)。
三、简答题(每小题5分,共15分)1
简要总结一下,采用哪几种技术手段可以加快存储系统的访问速度?2
一台机器的指令系统有哪几类典型指令?列出其名称。3画图说明现代计算机系统的层次结构。
考生信息栏系专业级班级姓名学号装订线四、计算题(12分)
CPU执行一段程序时,cache完成存取的次数为2420次,主存完成的次数为80次,已知cache存储周期为40ns,主存存储周期为200ns,求cache/主存系统的效率和平均访问时间。五、设计题(12分)
某计算机字长16位,主存容量为64K字,采用单字长单地址指令,共有40条指令,试采用直接、立即、变址、相对四种寻址方式设计指令格式。六、证明题(10分)
求证:[-y]补=-[y]补
(mod2n+1)七、设计题(14分)
CPU的数据通路如图1所示。运算器中R0~R3为通用寄存器,DR为数据缓冲寄存器,PSW为状态字寄存器。D-cache为数据存储器,I-cache为指令存储器,PC为程序计数器(具有加1功能),IR为指令寄存器。单线箭头信号均为微操作控制信号(
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