电子技术（第5版） 课件 6 数字电路基础

2024-01-24第6章数字电路基础

内容提要

本章先介绍数字电路基本概念及数制、码制等知识，然后介绍基本逻辑门和复合逻辑门电路的逻辑功能、逻辑电路的表示方法，最后介绍逻辑运算法则、逻辑函数的公式化简法和卡诺图化简法以及集成与非门的引脚定义及使用方法。2024-01-246.1数字电路概述6.2数制与码制6.3基本逻辑门6.4逻辑运算法则6.5集成与非门电路2024-01-246.1数字电路概述6.1.1数字信号与数字电路电信号可以分为模拟信号和数字信号两类，如图6.1所示。模拟信号的数值相对于时间的变化是连续的，处理模拟信号的电路称为模拟电路。数字信号的数值相对于时间的变化是离散的，处理数字信号的电路称为数字电路。数字信号具有不连续和突变的特性，也称脉冲信号。脉冲的含义是指脉动和冲击，数字电路是研究数字信号的产生、变换、传输、储存、控制和运算的电路。目前，数字信号和数字电路的应用越来越广泛。2024-01-24图6.1模拟信号和数字信号2024-01-24

6.1.2数字电路的特点数字电路主要有以下几个特点。（1）数字电路中，输入、输出电压值一般只有两种取值：高电平或低电平，常采用“1”和“0”两个数码来表示。它们不具有数量大小的意义，仅表示客观事物的两种相反状态，例如，电路的“通”和“断”，灯泡的“亮”和“灭”等，这里的“1”和“0”只是作为一种符号，称为“逻辑1”和“逻辑0”。规定用“1”表示高电平，用“0”表示低电平，称为正逻辑，反之，称为负逻辑，如图6.2所示。正逻辑和负逻辑与逻辑电路本身的好坏无关，但同一电路，采用正逻辑或负逻辑，表达的逻辑功能是不同的，如无特别说明，本书均采用正逻辑。2024-01-24图6.2正逻辑和负逻辑2024-01-24

（2）数字电路主要研究电路输入、输出的0，1符号序列间的逻辑关系。（3）数字信号有抗干扰能力强、功耗低、对电路元件精度要求不高、可靠性强、便于集成化和系列化生产等特点。（4）数字电路保密性好。信息能长期在电路中加以存储。数字电路与模拟电路的比较见表6.1。2024-01-24电路类型比较内容模拟电路数字电路工作信号模拟信号（如正弦波）数字信号（如矩形波）解决问题将小信号不失真地放大输出与输入之间的逻辑关系数学工具普通数学逻辑代数研究方法图解法、微变等效电路法逻辑状态、真值表、波形图、转换图单元电路放大器门电路、触发器三极管工作状态放大区（场效应管—恒流区）饱和区、截止区（场效应管—可变电阻区、夹断区）表6.1模拟电路与数字电路的比较

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6.1.3常见的脉冲波形及参数

脉冲的含义是指脉动和冲击，数字信号具有不连续和突变的特性，实质上是一种脉冲信号。从广义上来讲，凡是不连续的非正弦电压或电流都称为脉冲信号。常见的脉冲信号多种多样，如图6.3所示，它可以是周期性的，也可以是非周期性的或单次的。2024-01-24图6.3常见的脉冲波形

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数字电路常使用理想的矩形脉冲波作为电路的工作信号，如图6.4所示。实际的矩形脉冲波如图6.5所示，当它从低电平上升为高电平，或由高电平下降到低电平时，并不是理想的跳变，顶部也不平坦。为了具体说明矩形脉冲波形，常引入以下一些参数。（1）脉冲幅度Um。指脉冲信号变化的最大值。（2）脉冲前沿tr。指脉冲从10%Um上升到90%Um所需的时间。tr愈短，脉冲上升愈快，愈接近于理想的矩形波的上升跳变。2024-01-24图6.4理想矩形脉冲波形

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（3）脉冲后沿tf。指脉冲从90%Um下降到10%Um所需要的时间。（4）脉冲宽度tw。指脉冲从脉冲前沿的50%Um到脉冲后沿的50%Um所需的时间，也称脉冲持续时间、有效脉冲宽度等。（5）脉冲周期T。指相邻脉冲上相应点之间的时间间隔。（6）脉冲频率f。单位时间内的脉冲数，与周期T的关系为f=1/T。（7）脉宽比tw/T。指脉冲宽度与脉冲周期之比，也称占空系数，其倒数称为空度比。2024-01-24图6.5实际矩形脉冲波形

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6.2数制与码制

6.2.1数制数制是一种计数的方法，它是进位计数制的简称。

1.十进制（D）日常生活中人们最习惯用的是十进制。十进制是以10为基数的计数制。在十进制中，每位有0～9十个数码，它的进位规则是“逢十进一”。如[374.68]10=3×102+7×101+4×100+6×10

1+8×10

2

其中乘数102、101、100、10

1、10

2等，是根据各个数码在数中的位置得来的，称为该位的“权”，它们都是基数10的幂。数码与权的乘积称为加权系数，如上述的3×102、7×101、4×100、6×10

1、8×10

2。十进制的数值是各位加权系数的和。2024-01-24

任何一个十进制数N可表示为：

式中，[N]10表示十进制；

Ki为第i位的数码（Ki取值为0～9十个数码）；

10i为第i位的权。注意：小数点的前一位为第0位，即i=0。2024-01-24

2．二进制（B）一个电路用十种不同状态表示十个不同的数码是比较复杂的。因此，数字电路中应用最广泛的是二进制。二进制是以2为基数的计数制。在二进制中，每位只有0和1两个数码，它的进位规则是“逢二进一”，即1+1=10（读作“壹零”）。如[1011.01]2=1×23+0×22+1×21+1×20+0×2

1+1×2

2

式中各位的权都是2的幂，以上各位二进制数所在位的权依次为23、22、21、20、2

1、2

2。任何一个二进制数N可表示为：

式中，Ki只取0和1两个数码。2024-01-24

二进制数的四则运算是指两个二进制数码0和1之间进行的数值运算，其运算规则与十进制基本相同，只是二进制是逢二进一而不是十进制的逢十进一。例如，两个二进制数1101和110的四则运算如下：2024-01-242024-01-24

3．八进制（O）和十六进制（H）用二进制表示数时，数码串很长，书写和显示都不方便，在计算机上常用八进制和十六进制。八进制有0～7八个数码，进位规则是“逢八进一”，计数基数是8。如

[253.7]8=2×82+5×81+3×80+7×8

1

任何一个八进制数N可表示为：2024-01-24

十六进制有0～9，A（10），B（11），C（12），D（13），E（14），F（15）十六个数码，进位规则是“逢十六进一”，计数基数是16。如

[1AD.2]16=1×162+10×161+13×160+2×16

1

任何一个十六进制数N可表示为：2024-01-24

6.2.2数制转换

1．二进制、八进制、十六进制数转换成十进制数只要将二进制、八进制、十六进制数的各位加权系数求和即可。

例6.1

将二进制数[101.1]2、八进制数[175.2]8、十六进制数[1BE.8]16转换成十进制数。

解：[101.1]2=1×22+0×21+1×20+1×2

1

=[4+0+1+0.5]10=[5.5]10[175.2]8=1×82+7×81+5×80+2×8

1=[64+56+5+0.25]10=[125.25]10[1BE.8]16=1×162+11×161+14×160+8×16

1

=[256+176+14+0.5]10=[446.5]102024-01-24

2．十进制数转换为二进制、八进制、十六进制数对整数部分和小数部分分别进行转换。整数部分的转换可概括为“除2、8、16取余，后余先排”；小数部分的转换可概括为“乘2、8、16取整，整数顺排”。

例6.2将十进制数[35.625]10分别转换成二进制、八进制、十六进制数。2024-01-24解：（1）转换成二进制数。整数部分的转换小数部分的转换

[35]10=[100011]2[0.625]10=[0.101]2将整数部分与小数部分合起来，[35.625]10=[100011.101]2。2024-01-24（2）转换成八进制数。所以[35.625]10=[43.5]8。（3）转换成十六进制数。所以[35.625]10=[23.A]16。2024-01-24

3．二进制数与八进制、十六进制数之间的互换因二进制的基数为2，八进制、十六进制的基数分别为8、16，它们之间的关系是23=81、24=161，故三位、四位二进制数恰好对应一位八进制、十六进制数。因此，将二进制数转换成八进制、十六进制数时，只要以小数点为界，整数部分从右至左，每三位、四位一组；小数部分从左至右，每三位、四位一组，最低有效位不足三位、四位补0，再将每一组二进制数转换为相应的八进制、十六进制数，最后将结果按序排列即可。八进制、十六进制数转换成二进制数时，过程恰好和上面相反，即只要把原来的八进制、十六进制数逐位用相应的三位、四位二进制数代替即可。2024-01-24例6.3

将二进制数[10110101111.10101]2转换成八进制、十六进制数。解：（1）转换成八进制数。

010110101111.101010↓↓↓↓↓↓2657.52所以[10110101111.10101]2=[2657.52]8（2）转换成十六进制数。

010110101111.10101000↓↓↓↓↓5AF.A8所以[10110101111.10101]2=[5AF.A8]16。2024-01-24例6.4

将八进制数[367.52]8、十六进制数[3AC.9E]16转换成二进制数。解：（1）八进制数[367.52]8转换成二进制数。

367.52↓↓↓↓↓011110111.101010可略去最后的0，所以[367.52]16=[11110111.10101]2。（2）十六进制数[3AC.9E]16转换成二进制数。

3AC.9E↓↓↓↓↓001110101100.10011110所以[3AC.9E]16=[1110101100.1001111]2。2024-01-24

6.2.3码制码制是一种编码的规则，它是将若干个二进制数码0和1按一定的规则排列起来表示某种特定含义。如在开运动会时，每个运动员都有一个号码，这个号码只用于表示不同的运动员，并不表示数值的大小。利用二进制数码表示十进制数的编码方法称为二-十进制编码（BinaryCodedDecimalSystem），简称BCD码。它规定用四位二进制数码表示一位十进制数。2024-01-24

1．8421BCD码四位二进制数码共有24=16种组合，而十进制数只需要十种状态，一般使用前面十种，即0000（0）~1001（9），其余六种组合1010～1111是无效的。四位二进制中从高位到低位的权分别是23=8，22=4，21=2，20=1，故这种编码又称为8421BCD码。这种代码每一位的权是固定不变的，它属于恒权代码。例如，

[53]10=[01010011]8421BCD，[10010110]8421BCD=[96]10。

2．5421BCD码、2421BCD码

5421BCD码和2421BCD码都属于有权码，它们的位权从高到低依次是5、4、2、1和2、4、2、1。例如，

[72]10=[10100010]5421BCD，[01001011]5421BCD=[48]10；

[83]10=[11100011]2421BCD，[10011011]2421BCD=[68]10。2024-01-24

3.余3BCD码余3BCD码是由8421BCD码加3（0011）得来的，是一种无权码。余3BCD码中的0和9，1和8，2和7，3和6，4和5互为反码，用作十进制的数学运算十分方便。

4.格雷（Gray）码格雷（Gray）码也是一种无权码，其特点是相邻两个码之间仅有一位码有差异。常用于模拟量的转换，当模拟量发生微小变化而可能引起数字量发生变化时，格雷码仅改变一位，比其他码同时改变二位或多位更可靠，减少了出错的可能性。格雷码的规则较难记。表6.2所示是几种常见的代码。2024-01-24表6.2几种常见的代码十进制数二进制数有权码无权码8421BCD码5421BCD码2421BCD码余3BCD码格雷码00000000000000000001100001000100010001000101000001200100010001000100101001130011001100110011011000104010001000100010001110110501010101100010111000011160110011010011100100101017011101111010110110100100810001000101111101011110091001100111001111110011011010100001000000010000000100000100001111111511110001010100011000000110110100100010002024-01-24

6.3基本逻辑门.

所谓逻辑关系是指事物的“条件”与“结果”的关系。在数字电路中，用输入信号反映“条件”，用输出信号反映“结果”，这种电路称为逻辑电路。逻辑电路像门一样按照一定的条件“开”或“关”，又称为门电路。最基本的逻辑关系有3种：与逻辑、或逻辑和非逻辑，对应的逻辑门电路有与门、或门和非门。

6.3.1与逻辑及与门

1.与逻辑与逻辑关系是指某几个条件同时满足时其结果才成立。如图6.6（a）所示的是两个串联的开关控制一盏灯与逻辑电路，开关A，B的闭合是条件，灯亮是结果。显然，只有开关A，B都闭合，灯才会亮。2024-01-24图6.6与门电路及逻辑符号2024-01-24

2.与门如图6.6（b）所示的是二极管组成的与门电路。由图可知，在输入端A，B中只要有一个（或一个以上）为低电平0，则与输入端相连的二极管必然获得正向电压而导通，在二极管的钳位作用下，使输出Y为低电平0；只有输入A与B同时为高电平1时，输出Y才为高电平1。可见，输出端与两个输入端之间存在着与逻辑关系。与逻辑关系还可以用逻辑函数式来表示，称为逻辑乘Y=A·B=AB（6-1）逻辑乘的基本运算是：0·0=0；0·1=0；1·0=0；1·1=1。对于多输入的与逻辑可表示为：Y=ABCD…。与逻辑功能可用“全1出1，见0出0”的口诀来记忆。与门电路的逻辑符号如图6.6（c）所示。图6.6（d）为与门电路在不同输入逻辑变量时对应输出的逻辑函数波形图。2024-01-24

把输入变量可能的取值组合状态及其对应的输出状态列成表格，称为逻辑状态表或真值表。与门电路的逻辑状态见表6.3。ABY001101010001表6.3与门逻辑状态表

2024-01-246.3.2

或逻辑及或门1.或逻辑或逻辑关系是指在某几个条件中，只要有一个得到满足，结果就成立。如图6.7（a）所示是两个并联的开关控制一盏灯的或逻辑电路，开关A，B的闭合是条件，灯亮是结果。显然，开关A，B只要有任一个闭合，灯就会亮。2024-01-24图6.7或门电路及逻辑符号2024-01-24

2.或门和与门的分析方法一样，如图6.7（b）所示的二极管或门电路，只要输入端A或B中有一个是高电平1，相应的二极管就会导通，输出Y就是高电平1，只有输入A，B同时为低电平0时，Y才是低电平0。或逻辑用逻辑函数式表示，称为逻辑加

Y=A+B（6-2）逻辑加的基本运算是：0+0=0；0+1=1；1+0=1；1+1=1。对于多输入的或逻辑可表示为：Y=A+B+C+D+…。或逻辑功能可用“全0出0，见1出1”的口诀来记忆。或门电路的逻辑符号如6.7（c）所示。或门电路的逻辑状态见表6.4。2024-01-24表6.4或门逻辑状态表ABY0011010101112024-01-24

6.3.3非逻辑及非门

1.非逻辑非逻辑关系是指结果与条件相反。如图6.8（a）所示是一个开关和灯并联的非逻辑电路，开关A闭合是条件，灯亮是结果。显然，开关A闭合，灯不亮；开关A断开，灯反而亮。

2.非门如图6.8（b）所示的是三极管非门电路，当输入A为高电平1时，三极管处于饱和状态，输出Y为低电平0；当输入A为低电平0时，三极管处于截止状态，输出Y为高电平1。由于非门的输出信号与输入信号相位相反，故“非门”又称为“反相器”。2024-01-24图6.8非门电路及逻辑符号2024-01-24

非逻辑用逻辑函数式表示称为逻辑非，其逻辑表达式为：（6-3）上式中是反变量，读做A非。逻辑非的基本运算是：，。非逻辑功能为“有0出1，有1出0”。非门电路的逻辑符号如图6.8（c）所示。表6.5非门逻辑状态表AY0110

非门是只有一个输入端的逻辑门，非门电路的逻辑状态见表6.5。2024-01-24

例6.5

在三端输入的与门和或门的输入端A，B分别加上如图6.9（a），（b）所示的脉冲波形，C端接电源或接地，试画出与门及或门电路的输出波形。

解：当与门电路的输入端接电源时，相当于C=1；当或门电路的输入端接地时，相当于C=0。对应输入波形A，B的变化分段讨论，运用对应的逻辑关系得出与门的输出如图6.9（c）所示，或门的输出如图6.9（d）所示。2024-01-24图6.9例6.5的图

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6.3.4复合逻辑门在实际中可以将上述的基本逻辑门电路组合起来，构成常用的复合逻辑门电路，以实现各种逻辑功能。最常见的复合门电路有：与非、或非、与或非、异或、同或门等。与非门、或非门、与或非门电路分别是与、或、非三种门电路的串联组合。异或门电路的特点是两个输入端信号相异时输出为1，相同时输出为0，其逻辑电路如图6.10所示。同或门电路的特点是两个输入端信号相同时输出为1，相异时输出为0，其逻辑电路如图6.11所示（也可在异或门的最后加上一个非门构成）。2024-01-24图6.10异或门电路2024-01-24图6.11同或门电路表6.6列出了几种常见的复合逻辑函数及对应门电路的逻辑符号。2024-01-24表2.5几种常见的复合逻辑关系逻辑关系逻辑表达式记忆口诀逻辑符号与非全1出0见0出1或非全0出1见1出0与或非异或

相同出0相异出1同或

相同出1相异出0表6.6几种常见的复合逻辑关系

任一与门全1出0每个与门均见0则出1

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注意：一次异或逻辑运算只有二个输入变量，多个变量的异或运算，必须两个两个变量分别进行。例如A

B

C，先进行其中二个变量的异或运算，其结果再和第三个变量进行异或运算。同或运算也具有同样的特点。不仅二极管、三极管能构成门电路，场效应管也能构成门电路，而且在集成电路中应用很广。与三极管门电路相比，其特点是输入电阻高，电路损耗小，输出电压高。不管是哪一种器件构成的门电路，若其名称相同，则其逻辑关系和逻辑符号就相同。2024-01-24

6.3.5逻辑电路的表示方法表示一个逻辑电路有多种方法，常用的有：真值表、逻辑函数式、逻辑信号波形图、逻辑图、卡诺图5种。它们各有特点，相互联系、又可以相互转换，现介绍如下。

1.真值表真值表是根据给定的逻辑问题，把输入逻辑变量各种可能取值的组合和对应的输出函数值排列成的表格，它表示了逻辑函数与逻辑变量各种取值之间的一一对应关系。逻辑电路的真值表具有唯一性。当逻辑电路中有n个输入逻辑变量时，共有2n个不同的变量组合。在列真值表时，为避免遗漏，一般按n位二进制递增的方式列出。用真值表表示逻辑函数的优点是直观、明了，可直接看出逻辑电路输出与输入变量取值之间的关系。2024-01-24

2.逻辑函数式逻辑函数式是用与、或、非等基本运算来表示输入变量和输出函数因果关系的逻辑代数式。由真值表直接写出的逻辑式是标准的与-或逻辑式。写标准的与-或逻辑式的方法是：（1）把任意一组变量取值中的1代以原变量，0代以反变量，由此得到一组输入变量的与组合，如3个输入变量A，B，C为110时，则代换后的输入变量的与组合是。（2）把输出逻辑函数为1所对应的各输入变量的与组合相加，便得到标准的与-或逻辑式。2024-01-24

3.波形图波形图是按真值表画出的输入、输出关系的一系列波形，如表6.7所示。这种表示法形象、直观。2024-01-24表6.7与非门的关系逻辑函数表达式真值表波形图逻辑图卡诺图2024-01-24

4.逻辑图逻辑图是用基本逻辑门和复合逻辑门的逻辑图形符号组成的对应于某一逻辑功能的电路图，根据逻辑函数式画逻辑图时，只要把逻辑函数式中的各逻辑运算用相应门电路的逻辑图形符号代替，就可画出与逻辑函数对应的逻辑图。

5.卡诺图卡诺图是专门用来化简逻辑函数的，见6.4节。

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例6.6

已知逻辑函数：，试求它对应的真值表。解：将ABC取值的所有组合000，001，…111逐一代入表达式，填入真值表即可，见表6.8。表6.8例6.6的真值表ABCY000000110101011010011011110111112024-01-24

例6.7已知逻辑函数的真值表如表6.9所示，试写出逻辑式，并画出逻辑电路图。解：（1）写逻辑式：在真值表中，Y为1的输入变量取值组合只有000和111两种，将0代以输入变量的反变量，1代以输入变量的原变量，得到两个与项为和ABC，把它们相加便得到输出逻辑函数式为：

（2）根据逻辑式可画出图6.12所示的逻辑图。2024-01-24表6.9例6.7的真值表ABCY000011110011001101010101100000012024-01-24图6.12例6.7的图

2024-01-246.4逻辑运算法则6.4.1逻辑代数的基本运算法则和定律

逻辑代数是分析与设计逻辑电路的数学工具，逻辑代数的变量称为逻辑变量，表示的是逻辑关系，而不是数量关系，这是它与普通代数的本质区别。1．基本运算法则和定律

在逻辑代数中只有逻辑乘（“与”逻辑）、逻辑加（“或”逻辑）和求反（“非”逻辑）3种基本运算。根据这3种基本运算可以导出逻辑运算的一些法则和定律，见表6.10。2024-01-24表6.10逻辑代数的基本法则和定律0-1律自等律A+0=AA·1=A重叠律A+A=AA·A=A互补律交换律A+B=B+AA·B=B·A结合律(A+B)+C=A+(B+C)(A·B)·C=A·(B·C)A+1=1A·0=0A·2024-01-24分配律A(B+C)=A·B+A·C非非律

吸收律A+AB=AA(A+B)=A对合律反演律（摩根定律）A+B·C=(A+B)·(A+C)·2024-01-24

以上定律可用真值表证明，若等式两边式子的真值表相等，则证明等式成立。也可以由以上公式来相互证明。例6.8

利用真值表证明成立。

证明：把A、B的所有取值组合分别代入、进行逻辑运算，得到真值表如表6.11所示。表中第三列和第四列均分别对应相等，即证明了公式成立。··

··表6.11真值表

·AB0011010010001100·2024-01-24

例6.9

证明吸收律成立。

证明：注意：逻辑推演中的“等号”不是表示两边变量数值相等，而是说明等号两边函数式所表达的逻辑功能相同，因此，等号两边的各项不可随意消项或移项。2024-01-24

2.逻辑代数的三个重要规则逻辑代数的三个重要规则见表6.12。表6.12逻辑代数的三个重要规则规则内容举例代入规则在任何一个逻辑等式中，如果将等式两边所有出现某一变量A的地方，都代之以某个函数Z，则等式依然成立已知，如果以Z=AC代替等式中的A，则反演规则对于任意一个函数表达式Y，如果将Y中所有的“·”换成“+”，“+”换成“·”，“0”换成“1”，“1”换成“0”，原变量换成反变量，反变量换成原变量，则所得到的逻辑表达式就是逻辑函数Y的反函数已知·

·

，则

·

·1对偶规则对于任意一个函数表达式Y，如果将Y中的“·”换成“+”，“+”换成“·”，“0”换成“1”，“1”换成“0”，那么得到的新的表达式Y，称为Y的对偶式已知Y=A·(B+C)，则

Y

=A+B·C已知，则·注意：应用反演规则时，不在一个变量上的长非号应保持不变。2024-01-24

6.4.2逻辑函数的化简大多数情况下，由逻辑真值表写出的逻辑式，以及由此而画出的逻辑电路图往往比较复杂。如果可以化简，就可以合理选用元件，电路可靠性也因此而提高。逻辑函数的化简有两种方法，即公式化简法和卡诺图化简法。1.公式化简法公式化简法就是运用上述的逻辑代数运算法则和定律把复杂的逻辑函数式化成简单的逻辑式。现将常用的化简方法列于表6.13中。2024-01-24表6.13常用的化简方法名称所用公式方法说明举例并项法将两项合并为一项，并消去一个变量吸收法消去多余的乘积项AB消去法消去乘积项中多余的因子配项法重复写入某项，再与其它项配合化简可将一项拆成两项，将其配项，然后消去多余的项2024-01-24

公式化简法并没有统一的模式，要求对基本定律、基本公式、技巧规则比较熟悉，在化简比较复杂的逻辑函数时，通常要综合运用上面介绍的几种方法。

例6.10

应用逻辑代数运算法则化简下列各式。（1）（2）（3）（4）解：（1）（2）（3）2024-01-24

（4）

分配律 吸收律（） 分配律 非非律 反演律 吸收律（）

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逻辑函数的真值表是唯一的，但对应的逻辑表达式却是多种多样的。常用的有5种形式：与或表达式、或与表达式、与或非表达式、与非-与非表达式、或非-或非表达式。可运用逻辑函数的基本定律将逻辑表达式变换成不同的形式：与或表达式 与非-与非表达式 与或非表达式 或与表达式 或非-或非表达式上述各式中，与或表达式是最常见的，它比较容易与其他形式的表达式互换，但同一个逻辑函数得到的与或表达式也不唯一。由于生产和使用与非门集成电路较多，与非-与非表达式实用价值大。2024-01-24

2.卡诺图化简法卡诺图是逻辑函数的图解化简法，是根据逻辑变量中的变量组合按一定规则画出来的一种方块图，它克服了公式化简法对最终结果难以确定的缺点。卡诺图化简法具有确定的化简步骤，能比较方便地获得逻辑函数的最简与或式。（1）卡诺图的画法为了更好地掌握这种方法，必须理解下面几个概念。最小项。全部输入变量（每个变量以原变量或以反变量只出现一次）的每一种组合都称为最小项。n个变量的最小项有2n个。为了书写方便，用m表示最小项，其下标为最小项的编号。3个输入变量全体最小项的编号如表6.14所示。其它不同输入变量下的最小项表，可仿照表6.14绘制。2024-01-24ABC最小项简记符号000m0001m1010m2011m3100m4101m5110m6111m7表6.14三变量最小项表2024-01-24

相邻项。一个多变量逻辑表达式，如果其中两个最小项中只有一个变量为互反变量，其余变量均相同，则把这两项称为相邻项。例如，一个三变量逻辑函数中和两项就是相邻项，对两个相邻项消去那个互为反变量的变量，则两个相邻项可合并，即

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卡诺图。美国贝尔实验室工程师毛·卡诺（Karnaugh）首先把状态表重新排列，构成一个能直接看出各项之间相邻关系的方格表，称为卡诺图。用2n个小方格表示n个变量的2n个最小项，并且使逻辑相邻的最小项在几何位置上也相邻，按这样的相邻要求排列起来的方格图，叫作n个输入变量的最小项卡诺图，又称最小项方格图。图6.13所示是二～四变量的最小项卡诺图。图中横向变量和纵向变量的排列顺序，保证了最小项在卡诺图中的循环相邻性，即卡诺图中不仅每对小方格中的乘积项相邻，而且同一行左、右两侧及同一列顶部和底部的两小方格中的项也是相邻项。2024-01-24图6.13卡诺图

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标准与-或式。如一个逻辑式中的每一个与项都是最小项，则该逻辑式称作标准与-或式，又称为最小项表达式。任何一种形式的逻辑式都可以利用基本定律和配项法化为标准与-或式，并且标准与-或式是唯一的。例6.11把化成标准与-或式。解：从表达式中可以看出Y是四变量的逻辑函数，但每个乘积项中都缺少一个变量，不符合最小项的规定。为此，将每个乘积项利用配项法把变量补足为4个变量，并进一步展开，即得最小项。2024-01-24

（2）由逻辑表达式画出卡诺图首先将逻辑表达式写成标准与-或式形式，然后把表达式中出现的所有最小项，在卡诺图相应的方格中填上“1”，其余小方格填“0”（也可不填），就可得到逻辑函数卡诺图。例如，与逻辑表达式相对应的卡诺图如图6.14所示。图6.14从逻辑表达式画卡诺图

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（3）由卡诺图写出逻辑表达式卡诺图与逻辑表达式相对应，二者可以互换，根据逻辑表达式可以画出卡诺图，也可以从卡诺图写出逻辑表达式。若已知一个卡诺图，只要将图中小方格为“1”的对应变量，组合成一个乘积项，变量为“1”的用原变量表示，变量为“0”的用反变量表示，然后将所有乘积项相加可得相应的逻辑表达式。例如，与图6.15对应的三变量卡诺图相对应的逻辑表达式为：图6.15从卡诺图写出逻辑表达式

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（4）卡诺图化简的方法卡诺图化简法：是利用卡诺图化简逻辑函数的方法，其步骤和规则如下：第一步：画出相应变量逻辑函数的卡诺图。第二步：“填1”。就是把表达式中出现的所有最小项，在卡诺图相应的方格中填上1。第三步：“圈1”。也就是合并卡诺图中的相邻项，即把1按以下规则画成一个包围圈。①只有相邻的1才能合并，且每个包围圈只能包含2n个1，即只能按2n(n=0、1、2、3…）这样的数目画包围圈。②“1”可以被重复圈在不同的包围圈中，但新的包围圈必须有新的元素“1”

。③包围圈的个数应尽量少，使“与”项少；包围圈中含有“1”的个数应尽量多，使消去的变量多。④画包围圈时注意不要遗忘卡诺图中四周的相邻项。第四步：提出每个包围圈中最小项的共有变量（与项）。第五步：把共有变量（与项）写成或逻辑式，即为最简与或式。2024-01-24

卡诺图化简法的关键就是合并相邻项来消去有关变量。现以三变量和四变量的卡诺图为例来说明化简的方法。①两个相邻的小方格（包括处于一行或一列的两端），可以合并成一项，从而可以消去一个变量，如图6.16所示。图6.16两个相邻项的合并

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②四个小方格组合为一个大方格，或组成一行（列），或处于两行（列）的末端，或处于四角，则可以合并成一项，从而可以消去两个变量，如图6.17所示。图6.17四个相邻项的合并2024-01-24③八个小方格组成两行（列），或组成两边的两行（列），则可以合并成一项，从而可以消去三个变量，如图6.18所示。图6.18八个相邻项的合并

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例6.12利用卡诺图化简例6.11函数表达式。解：根据上题的结果，该表达式共有8个最小项，并且输入变量是4个。化简步骤如下：（1）画出四变量逻辑函数的卡诺图，见图6.19。图6.19四变量卡诺图2024-01-24

（2）在卡诺图相应的方格中填上“1”。（3）画包围圈“1”，如图6.19中虚线框所示。（4）提出包围圈内的共有变量，分别是和。（5）写出最简与或式：

在利用卡诺图化简逻辑函数的过程中，步骤（3）是关键，应特别注意包围圈不要画错。2024-01-24

例6.13

用卡诺图化简逻辑函数。

解：因为逻辑函数Y直接给出了8个最小项之和形式，并且输入变量是4个，所以可以直接填写卡诺图，如图6.20所示。将组成矩形的“1”圈起来，共有4个圈（注意不要漏掉任何一个“1”），合并后得到4项，即图6.20例6.13的卡诺图2024-01-24

例6.14

用卡诺图化简逻辑函数。

解：有时将Y转换为最小项之和的形式很麻烦，可直接由一般与或表达式填写卡诺图。Y是3变量的函数，填写卡诺图时可能会有重复，只填一个“1”就可以了，见图6.21。本题有两个结果。

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由图6.21（a）得：由图6.21（b）得：可见，一个函数的表达式可能不唯一，那么实现其逻辑函数的逻辑电路也就不唯一。图6.21例6.14的卡诺图2024-01-24

例6.15用卡诺图化简逻辑函数。

解：如果先将Y转换成与或式是相当烦琐的。我们知道，对应一组变量的取值，若，则，反之，，则。显然的卡诺图就是将Y的卡诺图中的“1”换成“0”，“0”换成“1”。可以直接圈Y的卡诺图的“0”（相当于圈的卡诺图的“1”），来求的最简表达式。反过来也一样：直接圈的卡诺图的“0”（相当于圈Y的卡诺图的“1”），来求Y的最简表达式。这里可以先填的卡诺图。

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具体填写方法与上例一样，如图6.22所示。直接圈卡诺图的“0”，合并化简得：图6.22例6.15的卡诺图2024-01-24

3.

具有约束项的逻辑函数的化简

（1）逻辑函数中的约束项约束项是指在某些逻辑函数中，对一些最小项加以约束，使其不会出现的项。如8421BCD编码取的是0000~1001这十种代码，而1010～1111这六种代码是不允许出现的。

（2）利用约束项化简逻辑函数2024-01-24

例6.16

，约束项是：和ABC。解：因为A、B、C不允许出现011和111，所以

=0、ABC=0。Y的卡诺图如图6.23所示，卡诺图对应约束项的位置填×。图6.23例6.16的卡诺图

按图6.23（a）化简，只圈“1”，得到。按图6.23（b）化简，把所有约束项都当1处理，将“×”和“1”一起圈：。2024-01-24把Y和的真值表列在一起如表6.15所示，可以发现，只有涂阴影的两行，Y和的函数值不相同，而这两行正是约束项对应的取值。也就是说，如果A、B、C遵守约束（即不出现011和111），则Y=。所以利用约束项可以使函数更简单。2024-01-24

上例约束条件可写成：，也可以使用最小项编号，约束项用di表示。即d4+d7=0，或。ABCYY

0000000100010110110110011101001101111101表6.15例6.16的真值表2024-01-24

例6.17化简。解：填写卡诺图，如图6.24所示，合并最小项时并不一定把所有的“×”都圈起来，要合理地利用约束项（需要时就圈，不需要时就不圈）。合并化简得：。图6.24例6.17的卡诺图

2024-01-246.5集成与非门电路

把分立与非门电路通过一定工艺集成在一块硅片上就制成了集成与非门电路。集成与非门电路包括双极型晶体管TTL与非门电路、单极型场效应管CMOS与非门电路等多种，它是小规模集成电路中最基本的品种。

6.5.1TTL与非门

TTL电路，即晶体管-晶体管逻辑（Transistor-TransistorLogic）电路，该电路的内部各级均由晶体管组成。TTL是一个电路系列，各种门电路都可以由TTL与非门电路变化得到。2024-01-24

1.TTL与非门的组成及功能分析TTL与非门电路是构成各种逻辑功能的TTL集成电路的基本单元电路。图6.25所示是TTL与非门的典型电路，它由三部分组成：VT1和R1为输入级，VT1为多发射极晶体管，起逻辑“与门”作用；VT2、R2和R3为中间级，是一个反相器，实现非功能；VT3、VT4、VT5和R4、R5为输出级，其中VT3、VT4组成复合管作为VT5的有源负载，可提高负载能力。2024-01-24图6.25TTL与非门2024-01-24

当VT1的任意一个输入端接低电平“0”时，则晶体管VT1相对应的一个发射极导通，VT1处于深度饱和，VT1的基极电压UB1很小，VT2和VT5管截止，电源+UCC通过R2向VT3、VT4提供电源，VT3和VT4管饱和导通，减去R2上的电压降和VT3、VT4发射结上的电压，输出为高电平，大约在3.6V左右。当VT1的发射极全接高电平“1”时，VT1管的发射极截止，VT1管基极电压UB1较大，UB1≈UBC1+UBE2+UBE5=0.7+0.7+0.7=2.1V，VT2和VT5管饱和导通，VT3和VT4管截止，输出为低电平0.3V。因此电路具有“与非”功能。2024-01-24

2.TTL与非门集成电路芯片

74LS系列是TTL集成门系列中运用最为广泛的一种集成门电路。我国这类产品以代号T开头，其中T4000系列与国际54/74LS系列通用。此类集成电路采用双列直插式封装，把集成电路标志（凹口）置于左方，逆时针自下而上依次读出外引线编号。图6.26所示为国际通用型号74LS00四二输入与非门的逻辑电路结构及外引线分布图，该集成块内含有四个二输入端与非门，共用一个电源UCC（引脚14）和共用一个接地点GND（引脚7）。图中A、B为各门的输入端，Y为输出端，其中1A、1B，1Y；2A、2B，2Y等为以字头数字区分的四个与非门。74LS00型号中，74表示中规模，L表示低功耗，S表示肖特基型管，00表示序号。2024-01-24图6.2674LS00四二输入与非门的逻辑电路结构及外引线分布图

分立元件构成的门电路在应用时有许多缺点，如体积大、可靠性差等，因此一般在电子电路中作为补充电路时用到。2024-01-24

例6.18用74LS00四二输入与非门构成一个二输入或门。

解：图6.27（a）所示为用与非门构成的或门逻辑电路，其真值表见表6.16，可见满足或门的逻辑功能。图6.27（b）所示为用74LS00集成电路连接成或门的电路。表6.16例6.18的真值表

ABY1Y2Y001100110110011110012024-01-24图6.27用74LS000组成或门电路2024-01-24

3.TTL与非门的传输特性

TTL与非门的电压传输特性是指空载条件（TTL与非门的一个输入端电压由0开始增大，其余输入端接高电平）下，输出电压uo与输入电压ui之间的关系曲线。图6.28（a）所示为测量电路，图6.28（b）所示为电压传输特性曲线，其主要参数说明如下。（1）输出高电平UOH。UOH是指与非门输入端至少有一个为低电平时的输出电压值。要求电压足够高，一般规定UOH≥2.4V。各个门电路的输出可能有差异，典型值是3.6V。（2）输出低电平UOL。UOL是指与非门输入端全为高电平时的输出电压值。要求电压足够低，一般规定UOL≤0.4V，典型值是0.3V。（3）输入低电平UiL。一般UiL=（0.1~0.8）V。2024-01-24图6.28测量电路与传输特性曲线2024-01-24

（4）输入高电平UiH。一般UiH=（2~3.6）V。（5）开门电平UON。UON是在保证输出为额定低电平的条件下，允许的最小输入高电平值。UON低，有利于高电平输入时的抗干扰能力。（6）关门电平UOFF。UOFF是在保证输出为额定高电平的90%条件下，允许的最大输入低电平值。UOFF高，有利于低电平输入时的抗干扰能力。（7）阈值电压UTH。UTH为电压传输特性曲线转折区中点对应的输入电压值（也称门限电压或门槛电压）。它是对应门开启与关闭分界线处的输入电压值。UTH≈1.4V。（8）高电平噪声容限UNH。UNH是输入高电平时，保证电路输出仍为低电平时的最大允许负向干扰电压。其值等于输入高电平与开门电平之差，即UNH=UiH

UON。2024-01-24

（9）低电平噪声容限UNL。UNL是输入低电平时，保证电路输出仍为高电平时的最大允许正向干扰电压。其值等于关门电平与输入低电平之差，即UNL=UOFF

UiL。（10）扇出系数N。N是指允许驱动同类与非门电路的最大数目。一般规定N≥8。（11）传输延迟时间。是指逻辑状态从门电路的输入端传送到输出端所需要的时间。通常将输出电压由低电平跳变为高电平时的传输延迟时间记做tPLH，把输出电压由高电平跳变为低电平时的传输延迟时间记做tPHL。在74系列门电路中tPLH略大于tPHL，它们的数值都是通过实验方法测定的。其值越小，门电路的工作速度越快。2024-01-24

6.5.2CMOS与非门

CMOS与非门是由NMOS集成电路及PMOS集成电路构成的互补对称的MOS集成电路。它的制造工艺复杂、成本高，但它具有突出的优点：静态功耗低，抗干扰能力强，工作稳定性好，是应用最广的一种集成电路。

1．CMOS反相器图6.29所示是CMOS反相器电路。VT1管为驱动管，是增强型NMOS管，VT2管是负载管，是增强型PMOS管。两只管子特性对称，跨导相等且较大，导通电阻小。当输入电压为高电平时，VT1管导通，VT2管截止，输出电压为低电平，且近似等于0V；当输入电压为低电平时，VT2管导通，VT1管截止，输出电压为高电平，且近似等于UDD，可见电路实现非逻辑功能：。常用的CMOS反相器型号有CC4069，CC4007等，它们都是六反相器。2024-01-24

2．CMOS与非门在CMOS反相器的基础上，可以很容易构成具有各种功能的逻辑门电路。C4011是CMOS四二输入与非门，可与74LS00代换（代换仅限使用5V电源）。图6.30所示的是CC4023与非门的外引线图。该电路内含三个三输入端与非门，共用一个电源UDD（引脚14）和共用一个接地点USS（引脚7）。

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图6.29CMOS反相器图6.30CC4023与非门的外引线图2024-01-24

CMOS与非门的工作电源电压范围很宽，从3～18V均可正常工作，与严格限制电源的TTL与非门相比要方便得多，它的缺点是速度比74LS系列低。我国优先选用数字集成电路国际通用品种列为国家标准，表6.17是常用的主要系列。表6.17数字集成电路的主要产品系列系列子系列名称国际型号部标型号TTLTTLHTTLSTTLLSTTLALSTTL基本型中速TTL高速TTL超高速TTL低功耗TTL先进低功耗TTLCT54/74CT54/74HCT54/74SCT54/74LSCT54/74ALST1000T2000T3000T4000MOSCMOSHCMOSHCMOST互补场效晶体管型高速CMOS与TTL兼容的高速CMOSCC4000CT54/74HCCT54/74HCTC00

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CT74LS系列是TTL类型中主要应用的产品系列，其品种和生产厂家非常多，价格较低。ALS系列是LS系列的后续产品，在速度和功耗等方面有较大改进，但目前在价格和品种方面还不及LS系列。

HC和HCT系列为高速CMOS电路，其工作速度已与LSTTL系列相当，而且其外引线排列和逻辑功能也与LSTTL系列相同。其中HCMOS的电源电压范围为3～18V，与CMOS电路相同；而HCMOST的电源电压、工作电平与LSTTL电路相同，因此HCT系列可与相应的LSTTL系列互换使用。2024-01-24

*6.5.3三态输出与非门三态输出与非门简称TS门，是一种可控与非门，与上述与非门电路不同，它的输入端多了一个控制端（或称使能端），输出端除可以出现高电平和低电平外，还可以出现第三种状态——高阻状态。TTL三态输出与非门有两种：低电平控制型三态门，即EN=0时三态门开门；高电平控制型三态门，即EN=1时三态门开门。其逻辑功能及逻辑符号如表6.18所示。74LS126是常用的集成三态门芯片。

2024-01-24表6.18三态输出与非门的逻辑关系名称逻辑符号逻辑表达式逻辑功能低电平控制型高电平控制型,Y高阻

，执行与非逻辑