CN115496022B 一种系统级数字电路升级优化方法及装置 （中国人民解放军海军工程大学）_第1页
CN115496022B 一种系统级数字电路升级优化方法及装置 （中国人民解放军海军工程大学）_第2页
CN115496022B 一种系统级数字电路升级优化方法及装置 （中国人民解放军海军工程大学）_第3页
CN115496022B 一种系统级数字电路升级优化方法及装置 （中国人民解放军海军工程大学）_第4页
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文档简介

本发明提供了一种系统级数字电路升级优字系统种类对元件清单中各种元件的最小逻辑法使用VHDL语言建模的阻容元件电路改成数字2S1：根据被升级优化的数字系统原理图生成元件清单S2：对元件清单中每种元件的最小逻辑单元进行VHDS3：采用最小逻辑单元的VHDL语言描述将以元件为S4：对无法使用VHDL语言建模的阻容元件电路改成S5：结合最小逻辑单元的输入网络名以及最小逻辑S6：当优化设计所用芯片存储容量大于单个功能S7：按照优化设计所用各芯片的编号，根据功能模块中3.根据权利要求1或2所述的系统级数字电路升能模块的数目为芯片存储容量的70％除以单个功能模块若单个功能模块设计需占用多个芯片，则采用功能模块的占用数据构建系统，用于根据被升级优化数字系统原理图生成元件清逻辑单元语言建模系统，用于对元件清单中每种元件的最小逻辑单元进行3网络表转换系统，用于采用最小逻辑单元的非VHDL语言建模的电路描述系统，用于对无法使用VHDL语言建模的功能模块的构建系统，用于结合最小逻辑单元的输入网络能模块为实现相同运算的最小逻辑单元设计配置文件的生成系统，用于按照芯片序列中各芯片的编号，根据8.根据权利要求6或7所述的系统级数字电路升级优模块的数目为芯片存储容量的70％除以单个功能模块的占用资源总若单个功能模块设计需占用多个芯片，则采用功能模块的占用4泛应用的有现场可编程门阵列(FPGA)和复杂可编程逻辑器件(CPLD)对早期数字系统进行级数字系统升级优化方法可快速完成数字系5逻辑单元为主体的网络表生成各芯片的VHDL描述文件，并提供芯片的外部管脚号，采用6元的输入网络名以及最小逻辑单元的实现功能，将更换后的数据库进行功能模块的划分，其中，功能模块为实现相同运算的最小逻辑单元设小逻辑单元为单元的网络表绘制的网络拓扑图进行拓展搜索直至到被优化数字系统输出数字电路中部分功能模块出现故障或升级，则可以直接采用相同的功能模块更换或升级，7元件为单元的网络表转换为以最小逻辑单元为单元的网络表；即采用以最小逻辑单元的名或人工辅助将更新后的数据库进行功能模块划分，自动计算各功能模块的占用资源数；8中，功能模块为实现相同运算的最小逻辑单元设计至一个模块构建的(现有技术没有公开9逻辑单元为单元的网络表绘制的网络拓扑图进行拓展搜索直至到被优化数字系统输出端数字电路中部分功能模块出现故障或升级，则可以直接采用相同的功能模块更换或升级，

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