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李中发
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大学数字逻辑电路-李中发-课件PPT,大学,数字,逻辑电路,李中发,课件,ppt
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数字逻辑电路,李中发 制作 中国水利水电出版社,第8章 常用时序逻辑部件,学习要点 理解寄存器、计数器等时序逻辑电路的工作原理和逻辑功能。 了解寄存器、计数器等中规模集成电路的使用方法。,8.2 十进制计数器,8.3 集成计数器,8.4 N进制计数器,8.5 寄存器,8.6 顺序脉冲发生器,退出,8.1 二进制计数器,第8章 常用时序逻辑部件,8.1 二进制计数器,在数字电路中，能够记忆输入脉冲个数的电路称为计数器。,计数器,二进制计数器,十进制计数器,N进制计数器,加法计数器,同步计数器,异步计数器,减法计数器,可逆计数器,加法计数器,减法计数器,可逆计数器,二进制计数器,十进制计数器,N进制计数器,8.1.1 同步二进制计数器,1、同步二进制加法计数器,输出方程：,驱动方程：,状态方程：,状态表：,状态图：,时序图：,推广到n位二进制同步加法计数器,驱动方程,输出方程,输出方程：,2、同步二进制减法计数器,驱动方程：,状态方程：,状态表：,状态图：,时序图：,推广到n位二进制同步减法计数器,驱动方程,输出方程,输出方程,3、同步二进制可逆计数器,电路图,1、异步二进制加法计数器,时钟方程,输出方程,8.1.2 异步二进制计数器,驱动方程,状态方程,2、异步二进制减法计数器,时钟方程,输出方程,驱动方程,状态方程,二进制异步计数器级间连接规律,8.2 十进制计数器,8.2.1 同步十进制计数器,1、同步十进制加法计数器,输出方程,驱动方程,状态方程,2、同步十进制减法计数器,输出方程,驱动方程,状态方程,3、同步十进制可逆计数器,实现同步十进制加法计数器的功能,实现同步十进制减法计数器的功能,1、异步十进制加法计数器,时钟方程,输出方程,8.2.2 异步十进制计数器,驱动方程,状态方程,2、异步十进制减法计数器,时钟方程,输出方程,驱动方程,状态方程,8.3 集成计数器,8.3.1 集成二进制计数器,1、集成同步二进制计数器,74LS163的引脚排列和74LS161相同，不同之处是74LS163采用同步清零方式。,CR=1时，异步清零。,CR=0、EN=1时，在CP脉冲上升沿作用下进行同步加法计数。,CR=0、CP=0时，在EN脉冲下降沿作用下进行同步加法计数。,CR=0、EN=0或CR=0、CP=1时，计数器状态保持不变。,2、集成异步二进制计数器,1、集成同步十进制计数器,集成十进制同步加法计数器74160、74162的引脚排列图、逻辑功能示意图与74161、74163相同，不同的是，74160和74162是十进制同步加法计数器，而74161和74163是4位二进制（16进制）同步加法计数器。此外，74160和74162的区别是，74160采用的是异步清零方式，而74162采用的是同步清零方式。 74190是单时钟集成十进制同步可逆计数器，其引脚排列图和逻辑功能示意图与74191相同。 74192是双时钟集成十进制同步可逆计数器，其引脚排列图和逻辑功能示意图与74193相同。,8.3.2 集成十进制计数器,2、集成异步十进制计数器,8.4 N进制计数器,8.4.1 N进制计数器的构成,1、用同步清零端或置数端归零构成N进置计数器,2、用异步清零端或置数端归零构成N进置计数器,（1）写出状态SN-1的二进制代码。 （2）求归零逻辑，即求同步清零端或置数控制端信号的逻辑表达式。 （3）画连线图。,（1）写出状态SN的二进制代码。 （2）求归零逻辑，即求异步清零端或置数控制端信号的逻辑表达式。 （3）画连线图。,利用集成计数器的清零端和置数端实现归零，从而构成按自然态序进行计数的N进制计数器的方法。,在前面介绍的集成计数器中，清零、置数均采用同步方式的有74LS163；均采用异步方式的有74LS193、74LS197、74LS192；清零采用异步方式、置数采用同步方式的有74LS161、74LS160；有的只具有异步清零功能，如CC4520、74LS190、74LS191；74LS90则具有异步清零和异步置9功能。,用74LS163来构成一个十二进制计数器。 （1）写出状态SN-1的二进制代码。,（3）画连线图。,SN-1S12-1S111011,（2）求归零逻辑。,例,D0D3可随意处理,D0D3必须都接0,用74LS197来构成一个十二进制计数器。 （1）写出状态SN的二进制代码。,（3）画连线图。,SNS121100,（2）求归零逻辑。,例,D0D3可随意处理,D0D3必须都接0,用74LS161来构成一个十二进制计数器。,SNS121100,例,D0D3可随意处理,D0D3必须都接0,SN-1S111011,1、提高归零可靠性的方法,8.4.2 计数器功能的扩展,2、计数器容量的扩展,异步计数器一般没有专门的进位信号输出端，通常可以用本级的高位输出信号驱动下一级计数器计数，即采用串行进位方式来扩展容量。,100进制计数器,60进制计数器,64进制计数器,8.5 寄存器,在数字电路中，用来存放二进制数据或代码的电路称为寄存器。,寄存器是由具有存储功能的触发器组合起来构成的。一个触发器可以存储1位二进制代码，存放n位二进制代码的寄存器，需用n个触发器来构成。,按照功能的不同，可将寄存器分为基本寄存器和移位寄存器两大类。基本寄存器只能并行送入数据，需要时也只能并行输出。移位寄存器中的数据可以在移位脉冲作用下依次逐位右移或左移，数据既可以并行输入、并行输出，也可以串行输入、串行输出，还可以并行输入、串行输出，串行输入、并行输出，十分灵活，用途也很广。,8.5.1 基本寄存器,1、单拍工作方式基本寄存器,无论寄存器中原来的内容是什么，只要送数控制时钟脉冲CP上升沿到来，加在并行数据输入端的数据D0D3，就立即被送入进寄存器中，即有：,2、双拍工作方式基本寄存器,8.5.2 移位寄存器,1、单向移位寄存器,并行输出,4位右移 移位寄存器,时钟方程：,驱动方程：,状态方程：,并行输出,4位左移 移位寄存器,时钟方程：,驱动方程：,状态方程：,单向移位寄存器具有以下主要特点： （1）单向移位寄存器中的数码，在CP脉冲操作下，可以依次右移或左移。 （2）n位单向移位寄存器可以寄存n位二进制代码。n个CP脉冲即可完成串行输入工作，此后可从Q0Qn-1端获得并行的n位二进制数码，再用n个CP脉冲又可实现串行输出操作。 （3）若串行输入端状态为0，则n个CP脉冲后，寄存器便被清零。,2、双向移位寄存器,M=0时右移,M=1时左移,3、集成双向移位寄存器74LS194,8.5.3 寄存器的应用,1、环形计数器,结构特点,即将FFn-1的输出Qn-1接到FF0的输入端D0。,工作原理,根据起始状态设置的不同，在输入计数脉冲CP的作用下，环形计数器的有效状态可以循环移位一个1，也可以循环移位一个0。即当连续输入CP脉冲时，环形计数器中各个触发器的Q端或端，将轮流地出现矩形脉冲。,能自启动的4位环形计数器,状态图,由74LS194构成的能自启动的4位环形计数器,时序图,2、扭环形计数器,结构特点,状态图,能自启动的4位扭环形计数器,8.6 顺序脉冲发生器,8.6.1 计数器型顺序脉冲发生器,在数字电路中，能按一定时间、一定顺序轮流输出脉冲波形的电路称为顺序脉冲发生器。,计数器型顺序脉冲发生器一般用按自然态序计数的二进制计数器和译码器构成。,顺序脉冲发生器也称脉冲分配器或节拍脉冲发生器，一般由计数器（包括移位寄存器型计数器）和译码器组成。作为时间基准的计数脉冲由计数器的输入端送入，译码器即将计数器状态译成输出端上的顺序脉冲，使输出端上的状态按一定时间、一定顺序轮流为1，或者轮流为0。前面介绍过的环形计数器的输出就是顺序脉冲，故可不加译
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