电工电子综合试验(2-)

1、精选优质文档-倾情为你奉上目录一各设计单元的设计过程及逻辑图1 信号源电路2 计时器电路3清零电路4校分电路（具有防抖功能）5报时电路二逻辑总图三体会及建议四所用元件部分功能表及引脚布局五参考文献一各设计单元的设计过程及逻辑图1 信号源电路逻辑图如下：利用NE555定时器设计成555触发器，可得矩形波。输出矩形波周期：tp1cln31.1RCtp2 fdln20.7R2C Ttp1tp20.7（R12R2）C将图中电阻和电容的数值代入上式，可得T=0.228ms。在经过CD4040的分频之后，即可得到频率（近似）为1Hz，2Hz，500Hz,1000Hz的时钟信号。2 计时器电路逻辑图如下：（

2、此处V1替代信号源单元用于调试，为了使电路稍微简单一些使用了多个VDD和地线）设计过程：两个CD4518分别对应分和秒的个位和十位，秒在1001时应进位，直接用个位的高位接在十位的下降沿时钟端，在1001回到0000时产生下降沿，达到进位。分计时器同理。十位的控制利用两个与非门来控制，经过BC与非再与非将空余一个输入，正好用于统一清零功能的实现，在秒进位到分时，秒的复位信号就是分的进位信号。3清零电路逻辑图：利用十位剩余的与非门输入连在清零开关，即可在开关接高电平时正常计数低电平时清零；个位清零则利用开关信号自己与非来控制，同样可以达到开关接高电平时正常计数低电平时清零。这样就可以实现统一清零

3、的功能。4校分电路（具有防抖功能）逻辑图：将开关信号与秒信号与非后再接入4518计数器，这样就可以在开关接高电平时，信号正常输入，而当开关接低电平时计数器秒信号始终为1，计数停止。利用与非门将校分信号与秒进位到分的信号与非，最后接回分的输入信号端，就可以实现正常计数和快速校分。利用D触发器实现防抖功能。如图，正常计时状态下，开关连接高电平，此时Q端输出高电平，总输出端的信号与秒的十位进位信号相同。当开关连接低电平时，Q端输出低电平，总输出端输出信号为2Hz的时钟信号。这样就可以消除开关在转换状态时产生抖动信号，产生跳数的现象。5报时电路逻辑图：电路每小时进行一次报时，从59分53秒开始报时，每

4、隔一秒发一声，共三声低音、一声高音。即59分53秒、59分55秒、59分57秒为低音，59分59秒为高音。实际上，需要在某一时刻报时，就将该时刻输出为“1”的信号作为触发信号，选通报时脉冲信号，进行报时即可。因此有：时刻分十位分个位秒十位秒个位音高频率m8m7m6m5m4m3m2m1s8s7s6s5s4s3s2s159分53秒0101100101010011低约500Hz59分55秒0101100101010101低约500Hz59分57秒0101100101010111低约500Hz59分59秒0101100101011001高约1000Hz对于分的十位个位和秒的十位，在鸣响的时候给出的信号

5、应该是一样的。所以公示中有共同项m7m5m4m1s7s5,剩下的就是考虑秒个位的区别在s1为1时，s3，s2中有一个为1即发出500HZ的低声鸣响，在s4为1时发出1000HZ的高声鸣响。因此，总结得出公式为： F ，其中F为最后要传到扬声器中的信号,f3为500HZ信号，f4为1KZ的信号。即可实现报时功能。二逻辑总图三体会及建议首先，要熟悉电路图，对计时器的各种功能进行分析，并且结合所学知识及所给的元器件来设计电路，分块设计并调试好。其次，实验线路连接要有层次，有条理。电路分块搭接，电源，地线首先搭好。连线长短要合适，避免交叉，使电路整齐，便于调试和检查。增强安全意识，电路出现问题迅速断电

6、，避免造成元器件损坏。实际元件的管脚布局与模拟逻辑图有些相差比较大，使得电路更为乱，因此在连接电路时应该注意管脚对应和布线的简洁。总体上，搭接电路时，应分块接，先接计数器部分，再接上清零部分，以及校分部分，以上三个部分应该每接好一个就即时用电路板上的时钟信号调试，若出现错误就可以检查排除；然后再接信号源部分，利用电路板上的指示灯测试1Hz，2Hz的信号，再接在之前的电路上；最后接上报时电路（因为报时电路相对于其他各部分是独立的）。这样分块搭接调试可以很快发现和解决问题，比整体接好在调试省去很多不必要的麻烦。在电路的改进和比较方面，我想提出几点：1、CD4518 用同步连接方式代替异步连接方式。

7、同步连接方式的优点是在完成同样功能的前提下，同步电路具有速度快，不容易产生竞争冒险的优点。缺点是在数字钟电路中，通过对比两种连接方式的电路图，可以明显看出：同步电路比异步电路要多用一个与非门。电路复杂度增加。综上所述，在对时间精度要求不是很高而电路复杂度不能很高的电路中采用异步电路即可2、采用数据选择器简化报时电路。在报时电路的设计过程中，所有功能都是用组合逻辑来实现。使得电路中有较多的逻辑门。使得电路的规模较大。因此，考虑用数据选择器来实现报时的功能。在数字钟的设计过程中，采用74151 八位数据选择器根据报时电路的逻辑表达式，将s2,s3,s4 三个信号作为数据选择器的选择变量， 将对D1

8、,D2,D3,D4接500Hz、1KHz 的频率去驱动蜂鸣器。四所用元件部分功能表及引脚布局清单：NE555 1 CD4040 1 12级二级制串行计数分频器CD4518 2 双BCD码同步加数器CD4511 4 BCD锁存，7段译码74LS00 3 2输入4正与非门74LS20 1 4输入端双与非门管脚图及逻辑功能表74LS21 3 4输入端双与门管脚图及逻辑功能表74LS74 1 双D触发器双字共阴字屏 20.047uf电容 11、3K电阻 1150电阻 4个1CD4511图4.1 CD4511引脚图输入输出LEDCBAgfedcba字符测灯0××××

9、;××11111118灭零10×00000000000消隐锁存111××××显示LE=01时数据译码110000001111110110000100001101110001010110112110001110011113110010011001104110010111011015110011011111006110011100001117110100011111118110100111001119表4.1 CD4511 逻辑功能表2、共阴双字显示器图4.2 共阴双字显示器引脚图3、NE555图4.3 NE555引脚图4、CD

10、4040图4.4 CD4040引脚图5、CD4518图4.5 CD4518引脚图CD4518逻辑功能如表4.2所示。输入输出CRCPENQ3Q2Q1Q0清零1××0000计数01BCD码加法计数保持0×0保持计数00BCD码加法计数保持01×保持表4.2 CD4518 功能表6、74LS0074LS00是一种十分常见的集成电路，其中集成了4个与非门。其引脚图如下：图4.6 74LS00引脚图7、74LS2074LS20同样是一种与非门集成电路，与74LS00不同的是它的每个与非门有4个输入端。其引脚图如下：图4.7 74LS20引脚图8、74LS2174LS21是一种4输入与门集成电路，其引脚图如下：图4.8 74LS21引脚图9、74LS7474LS74集成电路是一种D触发器。其引脚图如图2.12所示：图4.9 74LS74引脚图输入输出CPD清零×01×01置