四输入或非门电路和版图设计

1、 III成绩评定表学生姓名班级学号专业课程设计题目四输入或非门电路和版图设计评语组长签字：成绩日期年月曰课程设计任务书学院专业学生姓名班级学号课程设计题目四输入或非门电路和版图设计实践教学要求与任务：用tanner软件中的S-Edit编辑四输入或非门电路原理图。用tanner软件中的TSpice对四输入或非门电路进行仿真并观察波形。用tanner软件中的L-Edit绘制四输入或非门版图，并进行DRC验证。用tanner软件中的TSpice对版图电路进行仿真并观察波形。用tanner软件中的layout-Edit对电路网表进行LVS检验观察原理图与版图的匹配程度。工作计划与进度安排：第一周周一：

2、教师布置课设任务，学生收集资料，做方案设计。周二：熟悉软件操作方法。周三四：画电路图周五：电路仿真。第二周周一二：画版图。周三：版图仿真。周四：验证。周五：写报告书，验收。指导教师：年月曰专业负责人：年月曰学院教学副院长：年月曰沈阳理工大学课程设计I目录TOC o 1-5 h z目录III HYPERLINK l bookmark6 1.绪论1 HYPERLINK l bookmark8 设计背景1 HYPERLINK l bookmark10 设计目标1 HYPERLINK l bookmark12 2.四输入或非门22.1四输入或非门电路结构22.2四输入或非门电路仿真3四输入或非门的版图

3、绘制4四输入或非门的版图电路仿真5 HYPERLINK l bookmark16 2.5LVS检查匹配6总结7 HYPERLINK l bookmark22 附录一：原理图网表9 HYPERLINK l bookmark24 附录二：版图网表10沈阳理工大学课程设计 绪论1.1设计背景Tanner集成电路设计软件是由TannerResearch公司开发的基于Windows平台的用于集成电路设计的工具软件。该软件功能十分强大，易学易用，包括S-Edit，T-Spice，W-Edit,L-Edit与LVS,从电路设计、分析模拟到电路布局一应俱全。其中的L-Edit版图编辑器在国内应用广泛，具有很高

4、知名度。L-EditPro是TannerEDA软件公司所出品的一个IC设计和验证的高性能软件系统模块,具有高效率,交互式等特点,强大而且完善的功能包括从IC设计到输出,以及最后的加工服务，完全可以媲美百万美元级的IC设计软件。L-EditPro包含IC设计编辑器(LayoutEditor)、自动布线系统(StandardCellPlace&Route)、线上设计规则检查器(DRC)、组件特性提取器(DeviceExtractor)、设计布局与电路netlist的比较器(LVS)、CMOSLibrary、MarcoLibrary，这些模块组成了一个完整的IC设计与验证解决方案。L-EditPro

5、丰富完善的功能为每个IC设计者和生产商提供了快速、易用、精确的设计系统。1.2设计目标用tanner软件中的原理图编辑器S-Edit编辑四输入或非门电路原理图。用tanner软件中的TSpice对四输入或非门电路进行仿真并观察波形。用tanner软件中的L-Edit绘制四输入或非门版图，并进行DRC验证。用tanner软件中的TSpice对四输入或非门的版图电路进行仿真并观察波形。用tanner软件中的layout-Edit对四输入或非门进行LVS检验观察原理图与版图的匹配程度。四输入或非门2.1四输入或非门电路结构四输入或非门是最常用的基本功能电路之一，广泛应用于数字逻辑电路电路设计中。在本

6、次课程设计中，使用tanner软件中的原理图编辑器S-Edit编辑四输入或非门电路原理图。真值表如下2.1。A.BUDYODOO1OOO1OO1OOC011O01O0O01O1OO11OQ111Q1OOO1OO1O101OO1O11O11OOO11O1Q111OQ111L0-表2.1四输入或非门的真值表原理图如图2.1。图2.1四输入或非门的原理图2.2四输入或非门电路仿真使用TSpice对原理图进行仿真。首先，生成电路网表，如图2.2。图2.2生成原理图电路网表给四输入或非门的输入端加入激励信号。仿真中高电平为Vdd=5V,低电平为Gnd,并添加输入输出延迟时间。进行仿真，输出波形。波形图如

7、下图2.3。IraFileEditView:bortOptl-onFWkidcwHelpgAst_-lwaJ4JX-Jel-rr-rr&p时B土：U图2.3四输入或非门电路输入输出波形图2.3四输入或非门的版图绘制用L-Edit版图绘制软件对四输入或非门电路进行版图绘制，版图结果如图2.4。IIWdi-i-1-ly.xwx.xwffmWm.wmwxxwmx.mw.5.xwvv:x.xw.x.w.:w:xw:-ImIxyxx.xwvxxdvvvvvx-wxx.sribssx.x.x.xwxxm.xx.wvwxx.x.xx.x.x.x.$-wwxwwixxm.mmxixnm.mx.mizzw.x.

8、x.xx5lXT.V-.mmx,.、-.-.m.xm-.-.:-lmxM.xwx.xxlirxxr-rx-rx-u.vxwx.-txxxF/ywwwy:x:l.xx.、.、.$5XX叱、xxmxbww.x.xmvmm?xmK.辻wmm.wm.wwwxxxy.lv:、H-:t-:t.v.vrvw.wx.m-.fzzzzv-c.f.xxsxx.x图2.4四输入或非门电路版图进行DRC检测，检测是否满足设计规则。如图2.5。口尺匚C-ormpletsIIuDFlCerrorefluitliI.DRCw：eabortei.两DisplayIlRCErrorpratorOK图2.5DRC验证结果2.4四

9、输入或非门的版图电路仿真同原理图仿真相同，首先生成电路网表。如图2.6。图2.6生成版图电路网表Pdldm1gl-ayr+isonLb.厂|fl?添加激励、电源和地，同时观察输入输出波形，波形如图2.7。图2.7四输入或非门电路版图输入输出波形图四输入或非门电路的版图仿真波形与原理图的仿真波形，基本一致，并且符合输入输出的逻辑关系，电路的逻辑设计正确无误。2.5LVS检查匹配对四输入或非门进行LVS检查验证，首先添加输入输出文件，选择要查看的输出,观察输出结果检查四输入或非门原理图与版图的匹配程度。首先导入网表，如下图2.8。图2.8导入网表输出结果如图2.9。图2.9电路LVS检查匹配图网表

10、匹配，设计无误。总结通过两周的课程设计学习，综合运用所学的知识完成了设计任务。使我更进一步熟悉了专业知识，并深入掌握仿真方法和工具、同时为毕业设计打基础的实践环节。进一步熟悉设计中使用的主流工具，学习了良好的技术文档撰写方法；了解后端设计；加深综合对所学课程基础知识和基本理论的理解好掌握，培养了综合运用所学知识，独立分析和解决工程技术问题的能力；培养了在理论计算、制图、运用标准和规范、查阅设计手册与资料以及应用工具等方面的能力，逐步树立正确的设计思想。在老师布置好题目后，我仔细进行设计，通过查阅各种参考书籍，最终把实验做出来了，达到了老师对本实验的要求。在这次设计中我收获颇丰，首先最直接的收获

11、就是我巩固了这节课所学的知识，把它运用到实践中去，并且学到了许多在课本中所没有的知识。通过查阅相关知识，进一步加深对tannerr的了解。其次，我们不管做什么都不能粗心，如我们输入程序时把字母打错了时，保存文件时名称与程序中的名称不一样时，都会导致编译错误，在此过程中虽然浪费了不少时间，但这也让我注意到实际做设计时应该应该注意的问题，意识到自己的不足，对学过的知识了解不够深刻，掌握的不足够。通过对典型IC集成电路的原理图和版图的绘制及仿真，对模拟电路的工作原理有了进一步的了解。再借助tanner软件模拟电路的原理图绘制及其版图生成，熟悉了tanner在此方面的应用，以增强计算机辅助电路模拟与设

12、计的信心。总的来说，这次设计还算成功，也让我明白了要把理论知识与实践结合起来，从实践中强化自己的理论，才能更好提高自己的实际动手能力和独立思考能力。如果在设计过程中遇到问题时，我们要有耐心的查找错误，这也是学习的过程。参考文献AlanHastings.TheArtofAnalongLayoutsecondEditior模拟电路版图的艺术.第二版.电子工业出版社，2013。王颖著集成电路版图设计与TannerEDA工具使用第二版西安电子科技大学出版社,2009。曾庆贵著.集成电路版图基础.机械工业出版社,2008。张为著.集成电路版图基础.清华大学出版社,2009。廖谷平，陆瑞强著.Tanner

13、Pro集成电路设计与布局实战指导科学出版社2007附录一：原理图网表.includeD:tannerTSpice70modelsml2_125.mdVddVddGnd5VAAGndPULSE(05010n10n50n100n)VBBGndPULSE(05010n10n50n200n)VCCGndPULSE(05010n10n30n100n)VDDGndPULSE(05010n10n50n150n).tran/op10n800nmethod=bdf.printtranv(Y)v(A)v(B)v(C)v(D)*SPICEnetlistwrittenbyS-EditWin327.03*Written

14、onJul3,2013at16:20:23*Wbe.optionsprobefilename=zou1.dat+probesdbfile=C:UsersSHARKDesktopzouzou1.sdb+probetopmodule=Module0*Maincircuit:Module0M1YAGndGndNMOSL=2uW=22uAD=66pPD=24uAS=66pPS=24uM2YBGndGndNMOSL=2uW=22uAD=66pPD=24uAS=66pPS=24uM3YCGndGndNMOSL=2uW=22uAD=66pPD=24uAS=

15、66pPS=24uM4YDGndGndNMOSL=2uW=22uAD=66pPD=24uAS=66pPS=24uM5YDN5VddPMOSL=2uW=22uAD=66pPD=24uAS=66pPS=24uM6N5CN6VddPMOSL=2uW=22uAD=66pPD=24uAS=66pPS=24uM7N6BN7VddPMOSL=2uW=22uAD=66pPD=24uAS=66pPS=24uM8N7AVddVddPMOSL=2uW=22uAD=66pPD=24uAS=66pPS=24u*Endofmaincircuit:Module0附录二：版图网表*CircuitExtractedbyTann

16、erResearchsL-EditVersion9.00/ExtractVersion9.00;*TDBFile:C:UsersSHARKDesktopzouzou.tdb*Cell:Cell0Version1.04*ExtractDefinitionFile:D:tannerLEdit90SamplesSPRexample1lights.ext*ExtractDateandTime:07/03/2013-15:15.includeD:tannerTSpice70modelsml2_125.md.includeD:tannerTSpice70modelsml2_125.mdVddVddGnd5

17、VAAGndPULSE(05010n10n50n100n)VBBGndPULSE(05010n10n50n200n)VCCGndPULSE(05010n10n30n100n)VDDGndPULSE(05010n10n50n150n).tran/op10n800nmethod=bdf.printtranv(2)v(A)v(B)v(C)v(D)*Warning:LayerswithUnassignedAREACapacitance.*Warning:LayerswithUnassignedFRINGECapacitance.*Warning:LayerswithZeroResistance.*NODENAMEALIASES*1=D(50.5,-10.5)*3=Gnd(2,-23.5)*4=Vdd(5,76.5)*5=A(8,-10.5)*6=B(21,-10.5)*9=C(35.5,-9.5)M12D8VddPMOSL=3uW=11u*M1DRAINGATESOURCEBULK(4940.55251.5)M2GndD2GndNMOSL=3uW=11u*M2DRAINGATESOURCEBULK(49-1.5529.5)M38C10VddPMOSL=3uW=11u*M3DRAINGATESOURCEBULK(3540.53851.5)M410B7