PSCAD中的逻辑运算_第1页
PSCAD中的逻辑运算_第2页
PSCAD中的逻辑运算_第3页
PSCAD中的逻辑运算_第4页
免费预览已结束,剩余1页可下载查看

下载本文档

版权说明:本文档由用户提供并上传,收益归属内容提供方,若内容存在侵权,请进行举报或认领

文档简介

MultipleInputLogicGates〔多输入规律门〕本组件模拟了标准的二进制规律门。非零值为规律真,零值为规律假。对于本组10。有以下规律运算:AND:在且仅在全部的输入都是规律真时,输出结果为规律真;OR: 任何一个输入为真则输出结果为规律真;XOR: XOR由Fortrannon-equivalence(.NEQV.)所打算。算后输出。当承受完全插值时,即使很大时间步长也能保证组件的准确性。Inverter〔规律非〕则插值信息同样可以由输入导至输出。FlipFlop〔触发器〕EMTDC插值算法相兼容,可设定使CC选择的是下降沿,则输出仅在时钟脉冲的下降沿处发生转变;同样地,假设选择上升沿,则输出状态仅在时钟脉冲的上升沿发生转变。QQ四种触发器构成细节,如下:JK假设组件配置为JK触发器,其具有以下特性和真值表:JKQ(n)Qbar(n)00Q(n-1)Qbar(n-1)01011010111-Q(n-1)1-Qbar(n-1)、K10Q(n)Qba〔nQbar(n-1)是上次转变状态。SR触发器:SRSRQ(n)Qbar(n)00Q(n-1)Qbar(n-1)0101101011Q(n-1)Qbar(n-1)、K10Q(n)Qba〔nQbar(n-1)是上次转变状态。D触发器:DD Q(n) Qbar(n)0 0 11 1 0Q(nQbar〔n〕是当前状态〔即它们对应于当前的输入〕。T触发器假设组件配置为T触发器,其具有以下特性和真值表:T Q(n)0 Q(n-1)1 1-Q(n-1)

Qbar(n)Qbar(n-1)1-Qbar(n-1)Q(nQbar〔n〕是当前状态〔即它们对应于当前的输入〕。HysteresisBuffer〔滞后缓冲器〕输入的门槛值时,才实现规律状态的转变,以此方法实现对噪声的过滤。假设输入信号在滞后区域内,在前一步的输出还将连续维持。10在很大的时间步长时,本组件也能保持很高的精度。8通道多重异或〕I48元素的数组,具体是哪个取决于组件输入参数的选择。S23元素的数组,代表了22或23大小的二进制编码,具体YIS的二进制代码等效十进制数。输出真值表如下:4x1:S(1)00S(2)I(1)Y01I(2)10I(3)11I(4)8x1:S(1)0S(2)0S(3)0YI(1)001I(2)010I(3)011I(4)100I(5)101I(6)110I(7)111I(8)ShiftRegister〔移位存放器〕N位串入/串出移位存放器由N个D型触发器级联而成。以以以以下图所示的是由D型触发4位移位存放器,其每一个触发器的输出Q作为下一个触发器的输入与D相连。为了将记录从一个模块转移到下一模块,触发器承受统一的时钟脉冲C。时钟脉冲SI进入最左

温馨提示

  • 1. 本站所有资源如无特殊说明,都需要本地电脑安装OFFICE2007和PDF阅读器。图纸软件为CAD,CAXA,PROE,UG,SolidWorks等.压缩文件请下载最新的WinRAR软件解压。
  • 2. 本站的文档不包含任何第三方提供的附件图纸等,如果需要附件,请联系上传者。文件的所有权益归上传用户所有。
  • 3. 本站RAR压缩包中若带图纸,网页内容里面会有图纸预览,若没有图纸预览就没有图纸。
  • 4. 未经权益所有人同意不得将文件中的内容挪作商业或盈利用途。
  • 5. 人人文库网仅提供信息存储空间,仅对用户上传内容的表现方式做保护处理,对用户上传分享的文档内容本身不做任何修改或编辑,并不能对任何下载内容负责。
  • 6. 下载文件中如有侵权或不适当内容,请与我们联系,我们立即纠正。
  • 7. 本站不保证下载资源的准确性、安全性和完整性, 同时也不承担用户因使用这些下载资源对自己和他人造成任何形式的伤害或损失。

评论

0/150

提交评论