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第5讲-基于原理图的简易数字系统设计1数字电路的FPGA设计与实现——基于QuartusPrime和VerilogHDLFPGADesignandImplementationofDigitalCircuits——BasedonQuartusPrimeandVerilogHDL实验原理ExperimentalPrinciples“5.12简易数字系统电路图

使用Quartus集成开发环境自带的门电路，基于原理图设计的简易数字系统电路图如下图所示，输入为A和B，非门输出为Y1、与门输出为Y2、与非门输出为Y3、或门输出为Y4、或非门输出为Y5、异或门输出为Y6。3简易数字系统表达式

由简易数字系统电路图所得到的表达式如下所示，其中Y1为非门输出、Y2为与门输出、Y3为与非门输出、Y4为或门输出、Y5为或非门输出、Y6为异或门输出。4

简易数字系统与外部电路连接图

下图为简易数字系统与外部电路的连接图，其中，输入端A和B使用拨动开关SW0和SW1来控制输入电平的高低，分别连接EP4CE15F23C8N芯片的W7和Y8引脚，输出端电平Y1～Y6则使用LED0～LED5表示，点亮为高电平，熄灭为低电平，对应EP4CE15F23C8N芯片引脚依次为Y4、W6、U7、V4、P4和T3。5实验步骤ExperimentalProcedure“5.26实验步骤7步骤1：新建工程步骤2：新建原理图文件步骤3：添加元件步骤4：添加布线步骤5：添加输入/输出端口步骤6：编译原理图工程步骤7：添加仿真文件步骤8：引脚约束步骤9：下载程序步骤10：固化程序仿真波形8本章任务ChapterTask“5.39本章任务10任务1：使用Quartus集成开发环境自带的门电路，基于原理图设计一个照明灯控制电路，该电路由A、B、C三个开关控制，要求改变任一个开关的状态，都能控制照明灯由亮到灭或由灭到亮变化。编写测试激励文件，对该电路进行仿真；编写引脚约束文件，其中输入A、B、C使用拨动开关，输出的照明灯使用LED。在Quartus集成开发环境中生成bit文件，并下载到FPGA高级开发系统进行板级验证。任务2：

某个股份公司由4名股东（甲、乙、丙和丁）管理。其中甲持有35%的股份，乙持有40%的股份，丙持有15%的股份，丁持有10%的股份。该公司的任何决议只有超过全部票数的60%才能获得通过，使用Quartus集成开发环境自带的门电路，基于原理图设计该决议电路，当决议通过时，输出为高电平。编写测试激励文件，对该电路进行仿真；编写引脚约束文件，其中输入甲、乙、丙和丁使用拨动开关，决议结果使用LED（点亮代表通过）。在Quartus集成开发环境中生成bit文件，并下载到FPGA高级开发系统进行板级验证。本章习题ChapterExercises“5.411本章习题12

1.总结在QuartusPrime环境下设计数字电路的步骤。2.要求

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