基于FPGA的直接数字频率合成技术设计

1、基于FPGA的直接数字频率合成技术设计作者：张华桦文章来源：国外电子元器件摘要：介绍了利用现场可编程逻辑门阵列FPGA实现直接数字频率合成（DDS）的原理、电路结构和优化方法。重点介绍了DDS技术在FPGA中的实现方法，给出了采用ALTERA公司的ACEX系列FPGA芯片EP1K30TC进行直接数字频率合成的VHDL源程序。直接数字频率合成（ -即，一般简称）是从相位概念出发直接合成所需波形的一种新的频率合成技术。它在相对带宽、频率转换时间、相位连续性、正交输出、高分辨率以及集成化等一系列性能指标方面已远远超过了传统频率合成技术。当累加器的很大时，最低输出频率可达、甚至。也就是说：的最低合成频

2、率接近于零频。如果为, 那么当为位时，其分辨率可达。转换时间最快可达的量级，这都是传统频率合成所不能比拟的。但它的不足之处是最高工作频率会受限、噪声和杂波不够理想。本设计采用 公司的芯片来实现技术。芯片属 公司的系列，该系列是公司着眼于通信、音频处理及类似场合应用而推出的器件系列芯片，它采用微米混合工艺，密度从门到门。所有系列器件均兼容、的，并支持锁相环电路。 采用查找表（）和（嵌入式阵列块）相结合的结构，可用来实现存储器、专用逻辑功能和通用逻辑功能，每个能提供比特的存储空间，每个包含个输入、一个可编程的触发器、进位链和一个层叠链。合理运用进位链能够提高系统运行速度。的最大系统门数为，它有个逻

3、辑宏单元数和个嵌入式阵列块，最大可提供的位，因而可完全满足设计的要求。的实现过程图为系统的基本原理图，图中的相位累加器由位全加器和位累加寄存器级联而成，可对频率控制字的进制码进行累加运算，是典型的反馈电路，产生的累加结果的高位作为查找表的取样地址值，而此查找表中储存了一个周期的正弦波幅度值。显然，此处存储器可以看作一个从相位到正弦幅值的转换器。这样，用的输出值来驱动，然后经滤波即可转换成所需要的模拟正弦波形；同时位累加输出又可作为全加器的下一轮数据与频率数据相加，直到相位累加器加满产生溢出，从而完成一个周期，也就是信号的频率周期。在中的实现考虑到本系统的规模以及以后的扩展需要，该系统中的电路采

4、用硬件描述语言来实现，因为语言设计的电路模块可以方便地移植到不同的芯片中。由于硬件原因，本系统的最高频率为，因此，采用常规设计即可满足要求，但若要应用于高速系统，还要采用一些提高系统运行速度的措施，如采用流水线技术，即在设计中把延时较大的组合逻辑块切割成两块大致相等的组合逻辑块，并在这两个逻辑块中插入触发器，也可通过多个触发器时钟来提高系统速度，还可以采用 公司的器件所特有的进位链来设计高速电路。 图所示为一个具有频率、相位与幅度调制的系统的组成框图。它的频率调制可以在调谐寄存器与相位累加器之间插入一加法器来实现，频率调制与相位调制有相同的分辨率，因此，频率可以覆盖整个调谐频段。相位调制器可通

5、过在相位累加器后插入一个加法器来实现。幅度调制则是在正弦查找表后插入一个乘法器来实现。该系统具有高精度、高稳定性等特点。 查找表的设计查找表在整个设计中是一个比较重要的部分。为了保证波形的平滑，设计时可将一个周期分为个点。但是，点数太多时，用文本方式输入可能有很多困难。因此，应当用语言描述正弦方程式，最后再将其转化为所需的文件。以下是其语言的源程序：() ; ;(;) (); 主模块设计主模块部分可根据上述原理，采用来描述，以下是部分源程序： ()( ) 时钟上升沿触发; 开始累加 ; ;( ); 累加结果的高位作为查找表的地址位_:_ 调用查找表 控制模块设计部分的系统控制是根据所需要的功能

6、（如相位调制、幅度调制等）要求而设计的，这一点也是利用了的灵活性。其部分程序如下： 调用主模块 ; : ;内部信号定义 :_; :_( );_: 调用主模块 (, ,); 连接内部端口 () 系统时钟的上升沿触发; ;结论本系统在频率不高于时能产生精确的正弦波形，而且十分稳定。由于基准时钟为，且分辨率为位，因此，该系统能产生的最低频率为，若要产生更低频率及更精确的波形，可以提高分辨率并相应减小基准时钟，这在中实现起来相当容易。实践证明：用设计电路较采用专用芯片更为灵活。因为，只要改变中的数据，就可以产生任意波形，因而具有相当大的灵活性。相比之下：的功能完全取决于设计需求，可以复杂也可以简单，而且芯片还支持在系统现场升级，虽然在精度和速度