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DDSDDS模块的设计是本系统的重点，也是本章阐述的重点。DDS模块主要是围绕13DDSAD9854的基本特性。 入 复位源4-2AD9854chart4-2AD9854functionand300MHz能输出一般调制信号，FSK，BPSK，PSK，CHIRP，AM100MHz80dB4814100MHz810MHzAD9854的封装图如下图4-3AD9854封装chart4-3AD9854chip4-1AD9854Table4-1AD9854parallelinterfaceregisters相位寄存器相位寄存器频率转换字频率转换字频率转换字三角频率字更新时钟计数器边沿速率计数器OSK输出边沿变化率控制器4-2AD9854Table5-2AD9854controlregisters７６５４３２１０NNN0INPLL围PLL通N位位2NOSK能OSK式NN通过并行总线将数据写入程序寄存器时，实际上只是暂存在I/O缓冲区中，只有提供更新信号，这些数据才会更新到程序寄存器。AD9854提供两种更新方式，内部更新和外部0x1F0位进行修改。4.4.2AD9854DDSDDSDDS同步工作的BB4-4DDSchart4-4mult-DDSconstitutionandDDSDDS信号之间以固定的相位差同步4-4右半部分给出了种错误的连接方式。参考时钟到DDSDDSDDSUpdateAD9854后会在内部系统时钟（由外部时钟倍频和锁相得到）Update4-5achart4-5aUpdateschedulinginsinglereferclock4.5bchart4-5aUpdateschedulingindiffernecereferclockAD9854AD9854MasterResetAD9854的寄存器恢复到默认值（4-AD98541AD9854MasterRest10个系统时钟的AD9854的程序寄存器都恢复为默认值。2,AD9854a,DDSSingleb,30MHz,210MHz,由于200MHz,PLL0x1e=0x3d；c,IDAC00。换字#1和相位偏置寄存器#1。5,AD9854Update，此时AD9854Update4.5的AD9854的初次同步输出后，若改变频率控制字，

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