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文档简介
数字电子技术智慧树知到课后章节答案2023年下临沂大学临沂大学
第一章测试
数字电路中用“1”和“0”分别表示两种状态,二者无大小之分。()
A:错B:对
答案:对
十进制数(9)10比十六进制数(9)16小。()
A:错B:对
答案:错
逻辑变量的取值,1比0大。()
A:对B:错
答案:错
2019个1连续异或的结果是1。()
A:错B:对
答案:对
要控制小狗向上移动10步,命令是()
A:4
B:移动10步C:16D:面向90度,移动10步E:面向0度,移动10步F:2
G:面向180度,移动10步H:1
答案:4
;面向0度,移动10步
若输入变量A、B全为1时,输出F=0,则其输入与输出关系是:()
A:与非B:或C:与D:非
答案:与非
与模拟电路相比,数字电路主要的优点有:()
A:容易设计B:抗干扰能力强C:保密性好D:通用性强
答案:抗干扰能力强;保密性好;通用性强
在何种输入情况下,“与非”运算的结果是逻辑0。()
A:全部输入是0B:仅一输入是0C:全部输入是1D:任一输入是0
答案:全部输入是1
电路如图(a),(b)所示,设开关闭合为1、断开为0;灯亮为1、灯灭为0。灯的状态F
对开关A、B、C的逻辑函数表达式分别为:()。
A:B:C:D:
答案:
用8421BCD码表示的十进制数45,可以写成:()
A:[01000101]BCDB:75C:[1010111]BCDD:[1011101]BCD
答案:[01000101]BCD
下列四个数中,最大的数是:()
A:(001010000010)8421BCD;B:(AF)16C:(10100000)2D:(198)10
答案:(10100000)2
第二章测试
逻辑函数表达式的化简结果是唯一的。()
A:对B:错
答案:错
若两个函数具有相同的真值表,则两个逻辑函数必然相等。()
A:错B:对
答案:对
约束项就是逻辑函数中不允许出现的变量取值组合,用卡诺图化简时,可将约束项当作1,也可当作0。()
A:错B:对
答案:对
有冒险必然存在竞争,有竞争就一定引起冒险。()
A:对B:错
答案:错
在利用卡诺图进行逻辑表达式化简时,4个最小项合并成一项时可以消去的变量的个数是:()
A:4B:3C:2D:1
答案:2
L=AB+C的对偶式为:()
A:ABCB:A+B+CC:(A+B)CD:A+BC
答案:(A+B)C
下列几种说法中错误的是:()
A:卡诺图中1的个数和0的个数相同B:同一个卡诺图化简结果可能不是唯一的C:任何逻辑函数都可以用卡诺图表示D:逻辑函数的卡诺图是唯一的
答案:卡诺图中1的个数和0的个数相同
函数F(A,B,C)=AB+BC+AC的最小项表达式为:()
A:F(A,B,C)=∑m(3,5,6,7)B:F(A,B,C)=∑m(2,4,6,7)C:F(A,B,C)=∑m(0,2,3,4)D:F(A,B,C)=∑m(0,2,4)
答案:F(A,B,C)=∑m(0,2,4)
引起组合电路中竞争与险象的原因是:()
A:逻辑关系错B:电路时延C:干扰信号D:电源不稳定
答案:电路时延
逻辑函数Y=ABC+A+B+C的最简与或形式为:()
A:0
B:A+B+CC:1D:已是最简与或形式
答案:A+B+C
下列函数中,是最小项表达式形式的是:(
)。
A:B:C:D:
答案:
A:B:C:D:
答案:
A:B:C:D:
答案:
A:B:C:D:
答案:
A:
B:C:D:
答案:
第三章测试
将二个或二个以上的普通TTL与非门的输出端直接相连,可实现线与。()
A:错B:对
答案:错
CMOS门电路的闲置输入端可以悬空。()
A:对B:错
答案:错
CMOS或非门与TTL或非门的逻辑功能完全相同。()
A:错B:对
答案:对
当TTL与非门的输入端悬空时相当于输入为逻辑1。()
A:对B:错
答案:对
以下电路中常用于总线应用的:()
A:CMOS与非门B:TSL传输门C:OC门D:漏极开路门
答案:TSL传输门
在TTL逻辑门中,为实现“线与”,应选用:()
A:与非门B:OC门C:三态门D:异或门
答案:OC门
可用于总线结构进行分时传输的门电路是:()
A:OCB:同或门C:异或门D:三态门
答案:三态门
以下电路中可以实现“线与”功能的有:()
A:与非门B:三态输出门C:漏极开路门D:集电极开路门
答案:漏极开路门;集电极开路门
三极管作为开关使用时,要提高开关速度,可以:()
A:降低饱和深度B:采用抗饱和三极管C:采用有源泄放回路D:增加饱和深度
答案:降低饱和深度;采用抗饱和三极管;采用有源泄放回路
CMOS数字集成电路与TTL数字集成电路相比突出的优点是:()
A:高速度B:电源范围宽C:低功耗D:抗干扰能力强
答案:电源范围宽;低功耗;抗干扰能力强
对于TTL与非门闲置输入端的处理,可以:()
A:通过3kΩ电阻接电源B:接地C:接电源D:与有用输入端并联
答案:通过3kΩ电阻接电源;接电源;与有用输入端并联
在正逻辑条件下,如图所示的逻辑电路为(
)。
A:与非门
B:非门
C:或门
D:与门
答案:与门
已知某二变量输入逻辑门的输入A、B及输出Y的波形如图所示,则可判断该逻辑门为:(
)。
A:与非门
B:或非门
C:异或门
D:与门
答案:与门
第四章测试
编码与译码是互逆的过程。()
A:错B:对
答案:对
共阳接法发光二极管数码显示器需选用有效输出为高电平的七段显示译码器来驱动。()
A:错B:对
答案:错
八路数据分配器的地址输入(选择控制)端有8个。()
A:错B:对
答案:错
十六路数据选择器的地址输入(选择控制)端的个数为:()
A:4B:8C:16D:2
答案:4
欲对全班43个学生以二进制代码编码表示,最少需要二进制码的位数是:()
A:8B:43C:5D:6
答案:6
利用2个74LS138和1个非门,可以扩展得到1个()线译码器。
A:无法确定B:3-8C:4-16D:2-4
答案:4-16
一位8421BCD码译码器的数据输入线与译码输出线的组合是:()
A:4:10B:2:4C:1:10D:4:6
答案:4:10
已知74LS138译码器的输入三个使能端(E1=1,E2A=E2B=0)时,地址码A2A1A0=011,)。则输出Y7~Y0是:()
A:11111111B:11110111C:11111101D:10111111
答案:11110111
与4位串行进位加法器比较,使用超前进位全加器的目的是:()
A:完成4位串行加法B:完成4位加法C:完成自动加法进位D:提高运算速度
答案:提高运算速度
如图所示组合逻辑电路的功能为半加器。()
A:对B:错
答案:对
如图所示所示组合逻辑电路的功能为:()
A:判断输入变量是否相等
B:判断输入变量的奇偶性
C:实现输入变量的相减
D:实现输入变量的相加
答案:判断输入变量是否相等
用数据选择器实现逻辑函数的逻辑图如图所示,则逻辑函数Y=AB+BC+AC。()
A:对B:错
答案:对
如图所示,图中Y的最简与或表达式为:()
A:B:C:D:
答案:
A:错B:对
答案:错
第五章测试
RS触发器的约束条件RS=0表示不允许出现R=S=1的输入。()
A:对B:错
答案:对
由两个TTL或非门构成的基本RS触发器,当R=S=0时,触发器的状态为不定。()
A:对B:错
答案:错
同步触发器存在空翻现象,而边沿触发器和主从触发器克服了空翻。()
A:对B:错
答案:对
对边沿JK触发器,在CP为高电平期间,当J=K=1时,状态会翻转一次。()
A:错B:对
答案:错
下列触发器中没有约束条件的是:()
A:边沿D触发器B:基本RS触发器C:主从RS触发器D:同步RS触发器
答案:边沿D触发器
如果把触发器的JK输入端接到一起,该触发器就转换成()触发器。
A:RSB:T′C:TD:D
答案:T
同步RS触发器的两个输入信号RS为00,要使它的输出从0变成1,它的RS应为:()
A:00B:10C:01D:11
答案:01
如果把D触发器的输出Q反馈连接到输入D,则输出Q的脉冲波形的频率为CP脉冲频率f的:()
A:二倍频B:二分频C:不变D:四分频
答案:不变
要使JK触发器的输出Q从1就成0,它的输入信号JK就为:()
A:无法确定B:00C:01D:10
答案:01
边沿式D触发器是一种()稳态电路。()
A:单B:双C:多D:无
答案:双
如果触发器的次态仅取决于CP()时输入信号的状态,就可以克服空翻。
A:上升(下降)沿B:无法确定C:低电平D:高电平
答案:上升(下降)沿
为实现如图所示的触发器逻辑功能转换,虚线框中应为:(
)。
A:或门
B:与门
C:异或门
D:非门
答案:非门
已知某触发器的功能表如表所示(A、B为触发器的输入),则其输出信号的表达式为:(
)。
A:B:C:D:
答案:
第六章测试
时序逻辑电路的特点是:电路任一时刻的输出状态与同一时刻的输入信号有关,与原有状态没有任何的联系。()
A:对B:错
答案:错
异步时序电路的各级触发器类型不同。()
A:对B:错
答案:错
时序电路中一定含有记忆功能的器件。()
A:对B:错
答案:对
把一个5进制计数器与一个10进制计数器串联可得到15进制计数器。()
A:对B:错
答案:错
计数器的模是指构成计数器的触发器的个数。()
A:错B:对
答案:错
同步时序电路具有统一的时钟CP控制。()
A:对B:错
答案:对
同步计数器和异步计数器比较,同步计数器的最显著优点是:()
A:工作速度快B:不受时钟CP控制C:触发器利用率高D:电路简单
答案:工作速度快
N个触发器可以构成能寄存()位二进制数码的寄存器。
A:N-1B:NC:2ND:N+1
答案:N
根据组成计数器的各触发器状态翻转的时间与CP的关系分类,计数器可分为哪两种:()
A:二、十和N进制B:摩尔型和米里型C:加法、减法及加减可逆D:同步和异步
答案:同步和异步
四个触发器组成的环行计数器最多有多少个有效状态。()
A:4B:6C:16D:8
答案:4
8位移位寄存器,串行输入时经()个脉冲后,8位数码全部移入寄存器中。
A:2B:8C:4D:1
答案:8
下列电路中,不属于时序逻辑电路的是:()
A:数据选择器B:译码器C:计数器D:移位寄存器
答案:数据选择器;译码器
某计数器的输出波形如图所示,该计数器是:(
)
A:七进制计数器
B:五进制计数器C:四进制计数器D:六进制计数器
答案:六进制计数器
如图所示的电路(图中为上升沿Jk触发器),设触发器当前状态Q3
Q2
Q1为“100”,则在时钟作用下,触发器下一状态(Q3
Q2
Q1)为:()
A:“100”
B:“101”
C:“011”
D:“000”
答案:“011”
如图所示的时序逻辑电路的功能为:()
A:六进制加法计数器
B:六进制减法计数器
C:四进制减法计数器
D:四进制加法计数器
答案:四进制减法计数器
如图所示时序逻辑电路的功能为同步四进制加法计数器。()
A:对B:错
答案:对
如图所示时序逻辑电路的功能为四进制减法计数器。()
A:错B:对
答案:错
如图所示电路的逻辑功能为异步三进制加法计数器。(设触发器的初态为零)()
A:错B:对
答案:错
用集成计数器74HVC161构成的计数器为八进制加计数器。()
A:错B:对
答案:错
用集成计数器74HVC161构成的计数器如图(a)所示,则该计数器的状态转换图为(b)。()
A:错B:对
答案:对
第七章测试
RAM与ROM比较,其缺点是掉电丢失信息。()
A:错B:对
答案:对
存储器容量的扩展即是位数和字长的扩展。()
A:对B:错
答案:错
随机存取存储器具有读/写功能。()
A:对B:错
答案:对
ROM一般用在需要频繁读写数据的场合。()
A:错B:对
答案:错
FPGA是现场可编程门阵列,属于低密度可编程器件。()
A:对B:错
答案:错
随机存取存储器RAM中的内容,当电源断掉后又接通,则存储器中的内容将:()
A:全部改变B:保持不变C:不确定D:全部为1
答案:不确定
要构成容量为4K×8的RAM,需要多少片容量为256×4的RAM?()
A:2B:8C:32D:4
答案:32
ROM的存储容量为1K×8,则地址码和数据线的位数分别为:()
A:8;1B:1;8C:10;8D:8;10
答案:10;8
ROM可以用来存储程序、表格和大量固定数据,但它不可以用来实现:()
A:逻辑函数B:乘法运算C:代码转换D:计数器
答案:计数器
用1K×4位的DRAM设计4K×8位的存储器的系统需要的芯片数是:()
A:32B:8C:16D:4
答案:8
如图所示用ROM实现的逻辑函数是()。
A:B:C:D:
答案:
第八章测试
单稳态触发器状态有一个稳定状态和一个暂稳状态。()
A:错B:对
答案:对
石英晶体多谐振荡器的振荡频率与电路中的R、C成正比。()
A:错B:对
答案:错
多谐振荡器的输出信号的周期与阻容元件的参数成正比。()
A:错B:对
答案:对
施密特触发器能将缓慢变化的非矩形脉冲变换成边沿陡峭的矩形脉冲。()
A:错B:对
答案:对
施密特触发器可用于将三角波变换成正弦波。()
A:错B:对
答案:错
555定时器不仅可以组成多谐振荡器,而且还可以组成单稳态触发器、施密特触发器。()
A:对B:错
答案:对
单稳态触发器的输出脉冲的宽度取决于:()
A:触发脉冲的宽度B:电源电压的数值C:电路本身的电容、电阻的参数D:触发脉冲的幅度
答案:电路本身的电容、电阻的参数
单稳态触发器的主要用途是:()
A:延时、定时、存储B:整形、鉴幅、定时C:整形、延时、鉴幅D:延时、定时、整形
答案:延时、定时、整形
为了提高多谐振荡器频率的稳定性,最有效的方法是:()
A:采用石英晶体振荡器B:保持环境温度不变C:提高电源的稳定度D:提高电容、电阻的精度
答案:采用石英晶体振荡器
能将正弦波变成同频率方波的电路为:()
A:555定时器B:多谐振荡器C:施密特触发器D:单稳态触发器
答案:施密特触发器
用来鉴别脉冲信号幅度时,应采用:()
A:多谐振荡器B:施密特触发器C:双稳态触发器D:单稳态触发器
答案:施密特触发器
555集成定时器构成的施密特触发器,当电源电压为15V时,其回差电压△UT值为:()
A:2.5VB:5VC:15VD:10V
答案:5V
某电路的输入波形UI
和输出波形UO
如图所示,则该电路为(
)。
A:施密特触发器
B:单稳态触发器
C:JK触发器
D:反相器
答案:单稳态
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